參數(shù)資料
型號(hào)： S1C17601F00E100
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 8.2 MHz, RISC MICROCONTROLLER, PQFP64
封裝： 10 X 10 MM, 0.50 MM PITCH, TQFP-64
文件頁(yè)數(shù)： 398/468頁(yè)
文件大?。?/td> 3387K
代理商： S1C17601F00E100
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Appendix C: Power Saving
S1C17601 TECHNICAL MANUAL
Seiko Epson Corporation
AP-37
This section describes clock systems that can be controlled via software and power-saving control details. For more
information on control registers and control methods, refer to the respective module sections.
System SLEEP (All clocks stopped)
Execute slp instruction
Execute the slp instruction when the entire system can be stopped. The CPU switches to SLEEP mode and
the system clocks stop. This also stops all peripheral circuits using clocks. Starting up the CPU from SLEEP
mode is therefore limited to startup using ports (described later).
System clocks
Clock source selection (OSC module)
Select between IOSC/OSC3 and OSC1 for the system clock source. Reduce current consumption by selecting
the OSC1 clock when low-speed processing is possible.
IOSC/OSC3 oscillation circuit stop (OSC module)
Operate the oscillation circuit comprising the system clock source. Where possible, stop the other circuit. You
can reduce current consumption by using OSC1 as the system clock and stopping the IOSC/OSC3 oscillation
circuit.
CPU clock (CCLK)
Execute the halt instruction
Execute the halt instruction when program execution by the CPU is not required—for example, when only
the display is required or for interrupt standby. The CPU switches to HALT mode and suspends operations,
but the peripheral circuits maintain the status in place at the time of the halt instruction, enabling use of
peripheral circuits for timers and interrupts. You can reduce power consumption even further by suspending
unnecessary peripheral circuits before executing the halt instruction. The CPU is started from HALT mode
using the port or interrupts from the peripheral circuit operating in HALT mode.
Low-speed clock gear selection (CLG module)
The CLG module can reduce CPU clock speeds to between 1/1 and 1/8 of the system clock via the clock gear
settings. Reduce current consumption by operating the CPU at the minimum speed required for applications.
Peripheral clock (PCLK)
PCLK stop (CLG module)
Stop the PCLK clock feed from the CLG to peripheral circuits if none of the following peripheral circuits is
required.
Peripheral circuits operating with PCLK
Prescaler (PWM timer, remote controller, P port)
UART
8-bit timer
16-bit timer Ch.0 to Ch.2
Interrupt controller
SPI
I2C (master/slave)
Power supply control circuit
P port and port MUX (control register, chattering filter)
PWM timer
MISC register
A/D converter
SVD circuit
相關(guān)PDF資料
PDF描述
S1C17602F00E100 RISC MICROCONTROLLER, PQFP100
S1C17705B00E100 16-BIT, FLASH, 8.2 MHz, RISC MICROCONTROLLER, BGA240
S1C33205D00E100 MICROCONTROLLER, UUC158
S1C33205F00A200 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP128
S1C33209F01E 32-BIT, 60 MHz, RISC MICROCONTROLLER, PQFP128
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S1C17602 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:16-bit Single Chip Microcontroller
S1C17602F101100 功能描述:16位微控制器 - MCU 16-bit 64KB Flash LCD 40x4 RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線(xiàn)寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
S1C17604 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:16-bit Single Chip Microcontroller
S1C17611 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:16-bit Single Chip Microcontroller
S1C17611D101000 制造商:Epson Electronics America Inc 功能描述:16-bit, 32KB Flash LCD 8x8
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