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參數(shù)資料
| 型號(hào)： | PSD954F2 |
| 英文描述： | Configurable Memory System on a Chip for 8-Bit Microcontrollers(用于8位MCU的可配置存儲(chǔ)器系統(tǒng)) |
| 中文描述： | 在8片位微控制器可配置存儲(chǔ)系統(tǒng)（用于8位微控制器的可配置存儲(chǔ)器系統(tǒng)） |
| 文件頁(yè)數(shù)： | 36/90頁(yè) |
| 文件大小： | 543K |
| 代理商： | PSD954F2 |
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P
8
CSIOP SELECT
SRAM SELECT
PLD OUT 8
PORT A PLD INPUT 8
PORT C PLD INPUT 8
PORT B PLD INPUT 8
PORT D PLD INPUT 3
SECONDARY FLASH MEMORY SELECTS
DECODE PLD
GENERAL
PURPOSE PLD
PAGE
REGISTER
GPLD
PORT A
PORT B
PORT D
PORT C
FLASH MEMORY SELECTS
DATA
BUS
8
4
1
1
57
57
PLD OUT 8
PLD OUT 3
Figure 9. PLD Block Diagrams
PSD9XX Family
Preliminary Information
32
(INPUTS)
(24)
(16)
(1)
PDN (APD OUTPUT)
I/O PORTS (PORT A,B,C)
(8)
PGR0 -PGR7
A[15:0]
*
(3)
(3)
PD[2:0] (ALE,CLKIN,CSI)
CNTRL[2:0] (READ/WRITE CONTROL SIGNALS)
(1)
(1)
RESET
RD_BSY
RS0
CSIOP
8 FLASH MEMORY
SECTOR SELECTS
4 SECONDARY
FLASH MEMORY
SECTOR SELECTS
SRAM SELECT
I/O DECODER
SELECT
CSBOOT 0
CSBOOT 1
CSBOOT 2
CSBOOT 3
FS0
FS7
3
3
3
3
3
3
3
3
3
3
3
3
2
Figure 10. DPLD Logic Array
*
NOTE: The address inputs are A[19:4] in 80C51XA mode.
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