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參數(shù)資料
| 型號： | PSD413A2-C-70J |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 128K X 8 OTPROM, 40 I/O, PIA-GENERAL PURPOSE, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數(shù)： | 120/123頁 |
| 文件大?。?/td> | 755K |
| 代理商： | PSD413A2-C-70J |
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Obsolete
Product(s)
- Obsolete
Product(s)
PSD4XX Family
93
-20
-25
ZPLD_TURBO
Symbol
Parameter
Conditions
Min
Max Min Max
OFF
Unit
tAVQV (PA)
Address Valid to Data Valid
(Note 3)
95
120
Add 20
ns
tSLQV (PA)
CS Valid to Data Valid
100
120
Add 20
ns
tRLQV (PA)
RD to Data Valid
(Notes 1 and 4)
50
90
0
ns
tDVQV (PA)
Data In to Data Out Valid
35
50
0
ns
tQXRH (PA)
RD Data Hold Time
(Note 1)
0
ns
tRLRH (PA)
RD Pulse Width
(Note 1)
40
70
0
ns
tRHQZ (PA)
RD to Data High-Z
(Note 1)
35
60
0
ns
-20
-25
ZPLD_TURBO
Symbol
Parameter
Conditions
Min Max Min Max
OFF
Unit
tWLQV (PA)
WR to Data Propagation Delay
(Note 2)
60
0
ns
tDVQV (PA)
Data to Port A Data
Propagation Delay
(Note 5)
40
50
0
ns
tWHQZ (PA)
WR Invalid to Port A Tri-state
(Note 2)
35
60
0
ns
Port A Peripheral Data Mode Read Timing (3.0 V ± 10%)
Port A Peripheral Data Mode Write Timing (3.0 V ± 10%)
Microcontroller Interface – AC/DC Parameters (ZPSD4XXV Versions)
(3.0 V ± 10%)
NOTES: 1. RD timing has the same timing as PSEN, DS, LDS, UDS signals.
2. WR timing has the same timing as E, DS, LDS, UDS, WRL, WRH signals.
3. Any input used to select Port A Data Peripheral Mode.
4. Data is already stable on Port A.
5. Data stable on ADIO pins to data on Port A.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| PSD4235G2-A-20UI | 4M X 1 FLASH, 52 I/O, PIA-GENERAL PURPOSE, PQFP80 |
| PSD813F2A-15JI | 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52 |
| PSD834F2VA-15MI | 256K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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