參數(shù)資料
型號： PSD413A2-C-70J
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 128K X 8 OTPROM, 40 I/O, PIA-GENERAL PURPOSE, PQCC68
封裝： PLASTIC, LCC-68
文件頁數(shù)： 107/123頁
文件大?。?/td> 755K
代理商： PSD413A2-C-70J
Obsolete
Product(s)
- Obsolete
Product(s)
PSD4XX Family
81
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VCC
All Speeds
4.5
5
5.5
V
VIH
High Level Input Voltage
4.5 V < VCC < 5.5 V
2
VCC + 0.5
V
VIL
Low Level Input Voltage
4.5 V < VCC < 5.5 V
–0.5
0.8
V
VIH1
Reset High Level Input Voltage
(Note 1)
0.8 VCC
VCC + 0.5
V
VIL1
Reset Low Level Input Voltage
(Note 1)
–0.5
0.2 VCC –0.1
V
VHYS
Reset Pin Hysteresis
0.3
V
VOL
Output Low Voltage
IOL = 20 A, VCC = 4.5 V
0.01
0.1
V
IOL = 8 mA, VCC = 4.5 V
0.15
0.45
V
VOH
Output High Voltage
IOH = –20 A, VCC = 4.5 V
4.4
4.49
V
IOH = –2 mA, VCC = 4.5 V
2.4
3.9
V
VSBY
SRAM Standby Voltage
2.7
VCC
V
ISBY
SRAM Standby Current
VCC = 0 V
0.5
1
A
IIDLE
Idle Current (VSTDBY Pin)
VCC > VSBY
–0.1
0.1
A
VDF
SRAM Data Retention Voltage
Only on VSTBY
2V
ISB1
Standby Supply
Power Down Mode
CSI >VCC –0.3 V (Note 2)
50
100
A
(PSD4XX)
Current
Sleep Mode
CSI >VCC –0.3 V (Note 3)
30
40
A
ISB2
Standby Supply
Power Down Mode
CSI >VCC –0.3 V (Note 2)
25
50
A
(ZPSD4XX)
Current
Sleep Mode
CSI >VCC –0.3 V (Note 3)
10
20
A
ILI
Input Leakage Current
VSS < VIN < VCC
–1
±0.1
1
A
ILO
Output Leakage Current
0.45 < VIN < VCC
–10
± 5
10
A
ZPLD_TURBO = OFF,
See ISB1
f = 0 MHz (Note 4)
and ISB2
ICC (DC)
Operating
ZPLD Adder
ZPLD_TURBO = ON,
(Note 4a)
Supply Current
f = 0 MHz
400
700
A/PT
EPROM Adder
f = 0 MHz
0
mA
SRAM Adder
f = 0 MHz
0
mA
ZPLD AC Adder
See
Fig. 38
4
mA/MHz
CMiser = ON and
EPROM AC Adder
(8-bit bus mode)
0.8
2
mA/MHz
All other cases
1.8
4
mA/MHz
ICC (AC)
CMiser = ON and
(Note 4a)
(8-bit bus mode)
1.4
2.7
mA/MHz
SRAM AC Adder
CMiser = ON and
2
4
mA/MHz
(16-bit bus mode)
CMiser = OFF
3.8
7.5
mA/MHz
13.6 DC Characteristics (5 V ± 10% Versions)
NOTES: 1. Reset input has hysteresis. VIL1 is valid at or below 0.2VCC –0.1. VIH1 is valid at or above 0.8VCC.
2. CSI is high or internal Power Down mode is active.
3. Sleep mode bit is set and internal Power Down is active.
4. See ZPLD ICC/Frequency Power Consumption graph for details.
4a. IOUT = 0 mA.
相關(guān)PDF資料
PDF描述
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PSD4235G2-A-20UI 4M X 1 FLASH, 52 I/O, PIA-GENERAL PURPOSE, PQFP80
PSD813F2A-15JI 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52
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PSD4235G2-90U 功能描述:CPLD - 復(fù)雜可編程邏輯器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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