參數(shù)資料
型號： PNX1500G
廠商： NXP Semiconductors N.V.
英文描述： Connected Media Processor
中文描述： 互聯(lián)媒體處理器
文件頁數(shù)： 684/819頁
文件大小： 3895K
代理商： PNX1500G
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 23: LAN100 — Ethernet Media Access Controller
12NC 9397 750 14321
Koninklijke Philips Electronics N.V. 2002-2003-2004. All rights reserved.
Product data sheet
Rev. 2 — 1 December 2004
23-22
31:0
Offset 0x07 2214
HashFilterL
R/W
Bit 31:0 of the imperfect filter hash table for receive filtering.
Hash filter table MSBs register (HashFilterH)
31:0
Offset 0x07 2230/40/50/60 PatternMatch Unit 0/1/2/3 Mask LSBs Register (PatternMatchMask0/1/2/3L)
HashFilterH
R/W
Bit 63:32 of the imperfect filter hash table for receive filtering.
The PatternMatchMask registers specify a mask for the pattern matching windows so that some bytes can be masked out in
the CRC calculation.
The PatternMatchMask consists of 64 byte-enable signals, one for each byte in the pattern-matching window. The
pattern-matching mask is distributed over two 32-bit registers. The LAN100 has four pattern-matching units.
31:0
PatternMatchMask0/1/2/
3L
Offset 0x07 2234/44/54/64 PatternMatch Unit 0/1/2/3 Mask MSBs Register (PatternMatchMask0/1/2/3H)
R/W
Bits 31:0 of the pattern-matching mask for filter unit 0/1/2/3. Each bit
represents a byte-enable in the pattern-matching window.
The PatternMatchMask registers specify a mask for the pattern matching windows so that some bytes can be masked out in
the CRC calculation.
The PatternMatchMask consists of 64 byte-enable signals, one for each byte in the pattern-matching window. The pattern
matching mask is distributed over two 32-bit registers. The LAN100 has four pattern-matching units.
31:0
PatternMatchMask0/1/2/
3H
Offset 0x07 2238/48/58/68 PatternMatch Unit 0/1/2/3 CRC Register (PatternMatchCRC0/1/2/3)
R/W
Bits 63:32 of the pattern-matching mask for filter unit 0/1/2/3. Each
bit represents a byte-enable in the pattern-matching window.
Each of the four pattern-matching filters calculates a 32-bit CRC on a 64-byte window. If the CRC matches the 32-bit golden
CRC value in the filter unit’s CRC register, a match is found.
31:0
PatternMatchCRC0/1/2/
3
Offset 0x07 223C/4C/5C/6C PatternMatch Unit 0/1/2/3 Skip Bytes (PatternMatchSkip0/1/2/3)
R/W
The golden CRC for pattern-matching filter unit 0/1/2/3.
Each of the four pattern-matching filters calculates a 32-bit CRC on a 64-byte window. The window can have an offset with
respect to the start of the frame. The Pattern Match Unit 0/1/2/3 Skip Bytes register specifies the number of bytes that must
be skipped before starting the window.
31:0
PatternMatchSkip0/1/2/3 R/W
The number of bytes in a frame that need to be skipped before
starting pattern-matching filtering in unit 0/1/2/3.
Interrupt Status Register (IntStatus)
Offset 0x07 2FE0
The interrupt status register is read-only. Bits can be set via the IntSet register. Bits can be cleared via the IntClear register.
31:14
-
-
Unused
13
WakeupInt
RO
Interrupt was triggered by a Wakeup event detected by the receive
filter.
12
SoftInt
RO
Interrupt was triggered by software writing a 1 in the IntSet register.
11
TxRtDoneInt
RO
Interrupt was triggered because a real-time descriptor was
transmitted and the Interrupt bit in its descriptor was set.
10
TxRtFinishedInt
RO
Interrupt was triggered because all real-time descriptors have been
processed, so that now ProduceIndex == ConsumeIndex.
9
TxRtErrorInt
RO
Interrupt was triggered on real-time transmit errors: LateCollision,
ExcessiveCollision, ExcessiveDefer, and NoDescriptor or Underrun.
8
TxRtUnderrunInt
RO
Interrupt set on a fatal underrun error in the real-time transmit
queue. The fatal interrupt should be resolved by a Tx soft-reset. The
bit is not set in case of a non fatal underrun error.
Table 2: LAN100 Registers
…Continued
Bit
Symbol
Acces
s
Value
Description
相關PDF資料
PDF描述
PNX1501G Connected Media Processor
PNX1502G Connected Media Processor
PNX2000 Audio video input processor
PNX2000HL Audio video input processor
PNX3000 Analog front end for digital video processors
相關代理商/技術參數(shù)
參數(shù)描述
PNX1501E 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX15XX/266MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1501E,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX15XX/266MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1501E/G 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX15XX/266MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1501E/G,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1501EG 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Connected Media Processor
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