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參數(shù)資料
| 型號： | PI7C8150A-33 |
| 英文描述： | PCI Bridge | 2-Port PCI-to-PCI Bridge |
| 中文描述： | PCI橋| 2端口PCI至PCI橋 |
| 文件頁數(shù)： | 106/115頁 |
| 文件大小： | 879K |
| 代理商： | PI7C8150A-33 |
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PI7C8150B
2-PORT PCI-TO-PCI BRIDGE
ADVANCE INFORMATION
Page 106 of 115
July 31, 2003 – Revision 1.031
TCK. The value of the test mode state (TMS) input signal at a rising edge of TCK controls
the sequence of state changes. The TAP controller is initialized after power-up by applying
a low to the TRST_L pin. In addition, the TAP controller can be initialized by applying a
high signal level on the TMS input for a minimum of five TCK periods.
For greater detail on the behavior of the TAP controller, test logic in each controller state
and the state machine and public instructions, refer to the IEEE 1149.1 Standard Test
Access Port and Boundary-Scan Architecture document (available from the IEEE).
Table 16-2. JTAG Boundary Register Order
Boundary-Scan
Register Number
0
1
2
3
4
5
6
7
8
9
10
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43
44
45
46
47
48
Pin Name
Pin Number
Type
S_AD[0]
S_AD[1]
S_AD[2]
S_AD[3]
S_AD[4]
S_AD[5]
S_AD[6]
S_AD[7]
S_CBE[0]
S_AD[8]
S_AD[9]
S_M66EN
S_AD[10]
S_AD[11]
S_AD[12]
S_AD[13]
S_AD[14]
S_AD[15]
S_CBE[1]
S_PAR
S_SERR_L
S_PERR_L
S_LOCK_L
S_STOP_L
S_DEVSEL_L
S_TRDY_L
S_IRDY_L
S_FRAME_L
S_CBE[2]
S_AD[16]
S_AD[17]
S_AD[18]
S_AD[19]
S_AD[20]
S_AD[21]
S_AD[22]
S_AD[23]
S_CBE[3]
S_AD[24]
S_AD[25]
S_AD[26]
S_AD[27]
S_AD[28]
S_AD[29]
S_AD[30]
S_AD[31]
137
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140
141
143
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149
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204
206
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OUTPUT
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CONTROL
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INPUT
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CONTROL
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CONTROL
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