參數(shù)資料
型號： PCM18XT0
廠商： Microchip Technology
文件頁數(shù)： 47/183頁
文件大小： 0K
描述： MODULE PROC PIC18F4685
標準包裝： 1
附件類型： 處理器模塊
適用于相關(guān)產(chǎn)品： ICE2000
產(chǎn)品目錄頁面： 658 (CN2011-ZH PDF)
配用： ICE2000-ND - EMULATOR MPLAB-ICE 2000 POD
相關(guān)產(chǎn)品： DVA18XP400-ND - DEVICE ADAPTER 18F4220 PDIP 40LD
DVA18XP280-ND - DEVICE ADAPTER 18F2220 PDIP 28LD
DVA18PQ440-ND - DEVICE ADAPTER 18F4220 TQFP 44LD
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PIC18F46J50 FAMILY
DS39931D-page 140
2011 Microchip Technology Inc.
TABLE 10-5:
PORTB I/O SUMMARY
Pin
Function
TRIS
Setting
I/O
Type
Description
RB0/AN12/
INT0/RP3
RB0
1
I
TTL
PORTB<0> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<0> data output; not affected by analog input.
AN12
1
I
ANA
A/D Input Channel 12.(1)
INT0
1
I
ST
External Interrupt 0 input.
RP3
1
I
ST
Remappable Peripheral Pin 3 input.
0
O
DIG
Remappable Peripheral Pin 3 output.
RB1/AN10/
PMBE/RTCC/
RP4
RB1
1
I
TTL
PORTB<1> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<1> data output; not affected by analog input.
AN10
1
I
ANA
A/D Input Channel 10.(1)
PMBE(3)
0
O
DIG
Parallel Master Port byte enable output.
RTCC
0
O
DIG
Real-Time Clock Calender output.
RP4
1
I
ST
Remappable Peripheral Pin 4 input.
0
O
DIG
Remappable Peripheral Pin 4 output.
RB2/AN8/
CTED1/PMA3/
VMO/REFO/
RP5
RB2
1
I
TTL
PORTB<2> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
0
O
DIG
LATB<2> data output; not affected by analog input.
AN8
1
I
ANA
A/D Input Channel 8.(1)
CTED1
1
I
ST
CTMU Edge 1 input.
PMA3(3)
0
O
DIG
Parallel Master Port address.
VMO
0
O
DIG
External USB transceiver D – data output.
REFO
0
O
DIG
Reference output clock.
RP5
1
I
ST
Remappable Peripheral Pin 5 input.
0
O
DIG
Remappable Peripheral Pin 5 output.
RB3/AN9/
CTED2/PMA2/
VPO/RP6
RB3
0
O
DIG
LATB<3> data output; not affected by analog input.
1
I
TTL
PORTB<3> data input; weak pull-up when RBPU bit is
cleared. Disabled when analog input is enabled.(1)
AN9
1
I
ANA
A/D Input Channel 9.(1)
CTED2
1
I
ST
CTMU Edge 2 input.
PMA2(3)
0
O
DIG
Parallel Master Port address.
VPO
0
I
DIG
External USB transceiver D+ data output.
RP6
1
I
ST
Remappable Peripheral Pin 6 input.
0
O
DIG
Remappable Peripheral Pin 6 output.
Legend:
DIG = Digital level output; TTL = TTL input buffer; ST = Schmitt Trigger input buffer; ANA = Analog level
input/output; x = Don’t care (TRIS bit does not affect port direction or is overridden for this option)
Note 1:
Pins are configured as analog inputs by default on POR. Using these pins for digital inputs requires setting
the appropriate bits in the ANCONx register first.
2:
All other pin functions are disabled when ICSP or MPLAB ICD are enabled.
3:
This functionality is only available on 44-pin devices.
相關(guān)PDF資料
PDF描述
MAX6220ASA-5.0+T IC VREF SERIES PREC 5V 8-SOIC
RPP20-4824DW-F CONV DC/DC 20W 18-75VIN +/-24VOU
GCC31DCSH-S288 CONN EDGECARD 62POS .100 EXTEND
XRP2525ID-1-F IC PWR SW USB 3.0 SINGLE NSOIC8
PCM16XV0 PROCESSOR MODULE FOR 16F8XXA
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參數(shù)描述
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PCM-1900-1924 制造商:Panduit Corp 功能描述:
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