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參數(shù)資料
| 型號： | PCF8535 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | 65 x 133 pixel matrix driver |
| 中文描述： | 65 × 133像素矩陣驅(qū)動程序 |
| 文件頁數(shù)： | 5/52頁 |
| 文件大?。?/td> | 1765K |
| 代理商： | PCF8535 |
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1999 Aug 24
5
Philips Semiconductors
Objective specification
65
×
133 pixel matrix driver
PCF8535
5.1
Block diagram functions
5.1.1
O
SCILLATOR
The on-chip oscillator provides the display clock for the
system; it requires no external components. Alternatively,
an external display clock may be provided via the OSC
input. The OSC input must be connected to V
DD1
or V
SS1
when not in use. During power-down additional current
saving can be made if the external clock is disabled.
5.1.2
P
OWER
-
ON RESET
The on-chip Power-on reset initializes the chip after
power-on or power failure.
5.1.3
I
2
C-
BUS CONTROLLER
The I
2
C-bus controller detects the I
2
C-bus protocol, slave
address, commands and display data bytes. It performs
the conversion of the data input (serial-to-parallel).
The PCF8535 acts as an I
2
C-bus slave and therefore
cannot initiate bus communication.
5.1.4
I
NPUT FILTERS
Input filters are provided to enhance noise immunity in
electrically adverse environments; RC low-pass filters are
provided on the SDA, SCL and RES lines.
5.1.5
D
ISPLAY DATA
RAM
The PCF8535 contains a 65
×
133 bit static RAM which
stores the display data. The RAM is divided into 9 banks of
133 bytes. The last bank is used for icon data and is only
one bit deep. During RAM access, data is transferred to
the RAM via the I
2
C-bus interface. There is a direct
correspondence between the X address and the column
output number.
5.1.6
T
IMING GENERATOR
The timing generator produces the various signals
required to drive the internal circuitry. Internal chip
operation is not disturbed by operations on the data bus.
5.1.7
A
DDRESS COUNTER
TheAddressCounter(AC)sendsaddressestotheDisplay
Data RAM (DDRAM) for writing.
5.1.8
D
ISPLAY ADDRESS COUNTER
The display is generated by continuously shifting rows of
RAM data to the dot matrix LCD via the column outputs.
The display status (all dots on or off, normal or inverse
video) is set via the I
2
C-bus.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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