參數(shù)資料
型號(hào)： PCD5096
廠商： NXP Semiconductors N.V.
元件分類(lèi)： Codec
英文描述： Universal codec
中文描述： 通用編解碼器
文件頁(yè)數(shù)： 23/52頁(yè)
文件大?。?/td> 222K
代理商： PCD5096
1997 Jan 22
23
Philips Semiconductors
Preliminary specification
Universal codec
PCD5096
Table 28
Timing parameters in IOM mode; see Fig.7
Notes
1.
2.
Corresponds to the highest DCL frequency allowed (4.096 MHz) with a 10% margin.
C
L
= 150 pF.
Table 29
Timing parameters in Speech mode; see Fig.8
Notes
1.
2.
Corresponds to the DCL frequency (2.048 MHz) with a 10% margin.
C
L
= 150 pF.
SYMBOL
PARAMETER
MIN.
MAX.
UNIT
t
r(DCL)
t
f(DCL)
T
DCL
t
WH(DCL)
t
WL(DCL)
t
r(FSC)
t
f(FSC)
t
d(DCL-FSC)
t
su(FSC-DCL)
t
WH(FSC)
t
d(DLC-DO)
t
d(FSC-DO)
t
su(DI-DCL)
t
h(DI)
data clock rise time
data clock fall time
data clock period
data clock pulse width HIGH
data clock pulse width LOW
frame sync rise time
frame sync fall time
frame delay DCL to FSC
frame set-up time FSC to DCL
frame width HIGH
data delay from data clock
data delay from frame
set-up time DI to DCL
data hold time
220
(1)
80
80
t
WL(DCL)
60
130
t
WH(DCL)
50
60
60
60
60
60
100
(2)
150
(2)
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
SYMBOL
PARAMETER
MIN.
MAX.
UNIT
t
d(DCL-FSC)
t
su(FSC-DCL)
t
WH(FSC)
T
DCL
t
WL(DCL)
t
WH(DCL)
t
d(DCL-DO)
t
su(DI-DCL))
t
h(DI)
frame delay time DCL to FSC
frame set-up time FSC to DCL
frame width HIGH
data clock period
data clock pulse width LOW
data clock pulse width HIGH
data delay from clock
set-up time DI to DCL
data hold time
t
wL(DCL)
60
130
440
(1)
150
150
60
60
100
100
(2)
ns
ns
ns
ns
ns
ns
ns
ns
ns
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PDF描述
PCD5096H Universal codec
PCD6003 Digital telephone answering machine chip
PCD6003H Digital telephone answering machine chip
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