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參數(shù)資料
| 型號(hào)： | MTD505 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 5 Port 10M/100M Ethernet Switch |
| 中文描述： | 5端口10M/100M以太網(wǎng)交換機(jī) |
| 文件頁數(shù)： | 5/19頁 |
| 文件大小： | 202K |
| 代理商： | MTD505 |
5/19
MTD505 Revision 1.2 14/04/2000
MTD505
(Preliminary)
MYSON
TECHNOLOGY
Note: SGRAM/SDRAM access time: 10 ns (max)
TXD4_3
TXD4_2
TXD4_0
TXD4_1
COL4
19
20
22
21
O
O
O
O
I
Port4 MII transmit data bit_3. In RMII mode, this pin don’t use.
Port4 MII transmit data bit_2. In RMII mode, this pin don’t use.
Port4 RMII/MII transmit data bit_0.
Port4 RMII/MII transmit data bit_1.
Port4 MII collision input.
In RMII mode, this pin don’t use.
Port4 MII 25MHz clock output.
18
CLK25M
109
O
SGRAM/SDRAM Interface Pins
Name
Pin Number
I/O
O
Descriptions
AD[8:0]
59,60,61,62,
65,66,67,68,
69
Memory row/column address bus outputs
AD[7:0] are row/column address [7:0].
AD[8] : This pin should connect to SGRAM/SDRAM MSB address bit.
I/O Memory data bus
DQ[31:0]
38~42,45~55
,78~80,
83~95
75
76
77
73
74
70
57
RASB
CASB
WEB
BA
CS0B
CS1B
MEMCLK
O
O
O
O
O
O
O
SGRAM/SDRAM row address select
SGRAM/SDRAM column address select
SGRAM/SDRAM write enable
SGRAM/SDRAM bank select
Memory chip select 0
Memory chip select 1
Memory clock output.
LED Interface Pins
Name
Pin Number
I/O
I/O
Descriptions
LEDDATA
[7:0]
100,101,102,
103,104,105,
106,107
LED data output.
These LED pins report Port0~7 Link/Rx activity status using
LEDCLK1 strobe , and report packet buffer utilization status using
LEDCLK2 strobe.
LEDDATA [0] [1] [2] [3] [4] [5] [6] [7]
LEDCLK1 LR0 LR1 LR2 LR3 LR4 --- --- ---
LEDCLK2 Uti0 Uti1 Uti2 Uti3 Uti4 --- BFull MFail
note:
LRn: means per port’s Link_RxAct status.
Uti0: 5%, Uti1: 10%, Uti2: 20%, Uti3: 35%, Uti4: 50 above .
BFull: Buffer almost full alarm signal.
Mfail: External memory poer on test failure.
RMII/MII Port Interface Pins
Name
Pin Number
I/O
Descriptions
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PDF描述 |
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