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參數(shù)資料
| 型號： | MSC8144VT800A |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 60/80頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP QUAD 800MHZ 783FCBGA |
| 標準包裝： | 1 |
| 系列： | StarCore |
| 類型： | SC3400 內(nèi)核 |
| 接口： | 以太網(wǎng)，I²C，SPI，TDM，UART，UTOPIA |
| 時鐘速率： | 800MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 10.5MB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.00V |
| 工作溫度： | 0°C ~ 90°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 783-BBGA，F(xiàn)CBGA |
| 供應商設備封裝： | 783-FCPBGA（29x29） |
| 包裝： | 托盤 |
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MSC8144 Quad Core Digital Signal Processor Data Sheet, Rev. 16
Freescale Semiconductor
63
2.6.14
JTAG Signals
Figure 38 shows the Test Clock Input Timing Diagram
Figure 39 shows the boundary scan (JTAG) timing diagram.
Table 50. JTAG Timing
Characteristics
Symbol
All frequencies
Unit
Min
Max
TCK cycle time
tTCKX
36.0
—
ns
TCK clock high phase measured at VM = 1.6 V
tTCKH
15.0
—
ns
Boundary scan input data setup time
tBSVKH
0.0
—
ns
Boundary scan input data hold time
tBSXKH
15.0
—
ns
TCK fall to output data valid
tTCKHOV
—
20.0
ns
TCK fall to output high impedance
tTCKHOZ
—
24.0
ns
TMS, TDI data setup time
tTDIVKH
0.0
—
ns
TMS, TDI data hold time
tTDIXKH
5.0
—
ns
TCK fall to TDO data valid
tTDOHOV
—
10.0
ns
TCK fall to TDO high impedance
tTDOHOZ
—
12.0
ns
TRST assert time
tTRST
100.0
—
ns
Note:
All timings apply to OnCE module data transfers as well as any other transfers via the JTAG port.
Figure 38. Test Clock Input Timing
Figure 39. Boundary Scan (JTAG) Timing
TCK
(Input)
VM
tTCKX
tTCKH
tTCKR
TCK
(Input)
Data
Inputs
Data
Outputs
Data
Outputs
Input Data Valid
Output Data Valid
tBSXKH
tBSVKH
tTCKHOV
tTCKHOZ
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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