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參數(shù)資料
| 型號(hào)： | MSC8113TVT4800V |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 28/44頁 |
| 文件大?。?/td> | 0K |
| 描述： | DSP TRI-CORE 431-FCPBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | StarCore |
| 類型： | SC140 內(nèi)核 |
| 接口： | 以太網(wǎng)，I²C，TDM，UART |
| 時(shí)鐘速率： | 400MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 1.436MB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.10V |
| 工作溫度： | -40°C ~ 105°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 431-BFBGA，F(xiàn)CBGA |
| 供應(yīng)商設(shè)備封裝： | 431-FCPBGA（20x20） |
| 包裝： | 托盤 |
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MSC8113 Tri-Core Digital Signal Processor Data Sheet, Rev. 1
Freescale Semiconductor
34
2.5.10.2
MII Mode Timing
2.5.10.3
RMII Mode
Table 25. MII Mode Signal Timing
No.
Characteristics
Min
Max
Unit
803
ETHRX_DV, ETHRXD[0–3], ETHRX_ER to ETHRX_CLK rising edge set-up time
3.5
—
ns
804
ETHRX_CLK rising edge to ETHRX_DV, ETHRXD[0–3], ETHRX_ER hold time
3.5
—
ns
805
ETHTX_CLK to ETHTX_EN, ETHTXD[0–3], ETHTX_ER output delay
1
14.6
ns
Figure 24. MII Mode Signal Timing
Table 26. RMII Mode Signal Timing
No.
Characteristics
1.1 V Core
Unit
Min
Max
806
ETHTX_EN,ETHRXD[0–1], ETHCRS_DV, ETHRX_ER to ETHREF_CLK rising edge set-up
time
1.6
—
ns
807
ETHREF_CLK rising edge to ETHRXD[0–1], ETHCRS_DV, ETHRX_ER hold time
1.6
—
ns
811
ETHREF_CLK rising edge to ETHTXD[0–1], ETHTX_EN output delay.
3
12.5
ns
Figure 25. RMII Mode Signal Timing
Valid
ETHRX_CLK
ETHRX_DV
ETHRXD[0–3]
ETHTX_CLK
ETHRX_ER
ETHTX_EN
ETHTXD[0–3]
Valid
ETHTX_ER
803
804
805
Valid
ETHREF_CLK
ETHCRS_DV
ETHRXD[0–1]
ETHRX_ER
807
806
ETHTX_EN
ETHTXD[0–1]
Valid
811
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MSC8122MP8000 | DSP 16BIT 500MHZ MULTI 431FCPBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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