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參數(shù)資料
| 型號： | MSC8113TVT4800V |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 21/44頁 |
| 文件大?。?/td> | 0K |
| 描述： | DSP TRI-CORE 431-FCPBGA |
| 標準包裝： | 60 |
| 系列： | StarCore |
| 類型： | SC140 內(nèi)核 |
| 接口： | 以太網(wǎng)，I²C，TDM，UART |
| 時鐘速率： | 400MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 1.436MB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.10V |
| 工作溫度： | -40°C ~ 105°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 431-BFBGA，F(xiàn)CBGA |
| 供應商設(shè)備封裝： | 431-FCPBGA（20x20） |
| 包裝： | 托盤 |
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MSC8113 Tri-Core Digital Signal Processor Data Sheet, Rev. 1
Electrical Characteristics
Freescale Semiconductor
28
Figure 15 shows DSI asynchronous write signals timing.
Figure 16 shows DSI asynchronous broadcast write signals timing.
Figure 15. Asynchronous Single- and Dual-Strobe Modes Write Timing Diagram
Figure 16. Asynchronous Broadcast Write Timing Diagram
HD[0–63]
100
101
102
201
202
109
106
HWBSn2
108
110
111
112
HDBSn1
HTA4
HTA3
Notes:
1.
Used for single-strobe mode access.
2.
Used for dual-strobe mode access.
3.
HTA released at logic 0 (DCR[HTAAD] = 0) at end of access; used with pull-down implementation.
4.
HTA released at logic 1 (DCR[HTAAD] = 1) at end of access; used with pull-up implementation.
HA[11–29]
HCS
HCID[0–4]
HDST
HRW1
HRDS2
HD[0–63]
100
101
102
201
202
HWBSn2
112
HDBSn1
Notes:
1.
Used for single-strobe mode access.
2.
Used for dual-strobe mode access.
HA[11–29]
HCS
HCID[0–4]
HDST
HRW1
HRDS2
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
| MSC8113TVT4800V | 制造商:Freescale Semiconductor 功能描述:Tri-Core Digital Signal Processor |
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