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參數(shù)資料
| 型號： | MPC9352FAR2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | PLL BASED CLOCK DRIVER, 11 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封裝： | LQFP-32 |
| 文件頁數(shù)： | 4/16頁 |
| 文件大小： | 188K |
| 代理商： | MPC9352FAR2 |
MPC9352
MOTOROLA
TIMING SOLUTIONS
12
Figure 11. Single versus Dual Waveforms
TIME (nS)
VOL
TAGE
(V)
3.0
2.5
2.0
1.5
1.0
0.5
0
2
4
6
8
101214
OutB
tD = 3.9386
OutA
tD = 3.8956
In
Since this step is well above the threshold region it will not
cause any false clock triggering, however designers may be
uncomfortable with unwanted reflections on the line. To better
match the impedances when driving multiple lines the
situation in Figure 12. “Optimized Dual Line Termination”
should be used. In this case the series terminating resistors
are reduced such that when the parallel combination is added
to the output buffer impedance the line impedance is perfectly
matched.
Figure 12. Optimized Dual Line Termination
14
MPC9352
OUTPUT
BUFFER
RS = 22
ZO = 50
RS = 22
ZO = 50
14
+ 22 k 22 = 50 k 50
25
= 25
Figure 13. CCLK MPC9352 AC test reference for Vcc = 3.3V and Vcc = 2.5V
Pulse
Generator
Z = 50W
RT = 50
ZO = 50
RT = 50
ZO = 50
MPC9352 DUT
VTT
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PDF描述 |
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參數(shù)描述 |
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