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參數(shù)資料
| 型號： | MPC823UM_REV1_16-CPM7 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 10 AMP SUBMINIATURE POWER RELAY |
| 中文描述： | 通信處理器模塊 |
| 文件頁數(shù)： | 64/74頁 |
| 文件大?。?/td> | 234K |
| 代理商： | MPC823UM_REV1_16-CPM7 |
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Communication Processor Module
16-442
MPC823 REFERENCE MANUAL
MOTOROLA
S
C
1
P
PM—Prescale Modulus Select
This field specifies the divide ratio of the prescale divider in the SPI clock generator. The
BRGCLK is divided by 4 * ([PM0–PM3] + 1), thus giving a clock divide ratio of 4 to 64. The
clock has a 50% duty cycle.
16.12.4.1.1 SPI Examples With Different LEN Values.
The programming examples
below illustrate the effect of the LEN field and the REV bit in the SPMODE register on output
from the SPI controller. They illustrate the master mode output from the SPI controller as the
LEN varies. To help map the output process, make gthrough vthe binary symbols, use xto
indicate a deleted bit, use __ to indicate original byte boundaries, and use _ to indicate
original nibble (4-bit) boundaries.
The initial pattern for all examples is
ghij_klmn__opqr_stuv
.
Example 1
Data Selected:
Data Transmitted for REV=0:
Data Transmitted for REV=1:
LEN = 0x4 (Data Size = 5)
xxxj_klmn_xxxr_stuv
nmlk_j__vuts_r
j_nmlk__r_stuv
Example 2
Data Selected:
Data Transmitted for REV=0:
Data Transmitted for REV=1:
LEN = 0x7 (Data Size = 8)
ghij_klmn_opqr_stuv
nmlk_jihg__vuts_rqpo
ghij_klmn__opqr_stuv
Example 3
Data Selected:
Data Transmitted for REV=0:
Data Transmitted for REV=1:
LEN = 0xc (Data Size = 13)
ghij_klmn_xxxr_stuv
nmlk_jihg__vuts_r
r_stuv__ghij_klmn
Example 4
Data Selected:
Data Transmitted for REV=0:
Data Transmitted for REV=1:
LEN = 0xf (Data Size = 16)
ghij_klmn_opqr_stuv
nmlk_jihg__vuts_rqpo
opqr_stuv__ghij_klmn
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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