參數(shù)資料
型號： MCF5372
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Microprocessor Data Sheet
中文描述： 微處理器數(shù)據(jù)表
文件頁數(shù)： 35/42頁
文件大?。?/td> 787K
代理商： MCF5372
Preliminary Electrical Characteristics
MCF5373 ColdFire
Microprocessor Data Sheet, Rev. 0.3
Preliminary
Freescale Semiconductor
35
Figure 23
shows MII transmit signal timings listed in
Table 19
.
Figure 23. MII Transmit Signal Timing Diagram
5.14.3 MII Async Inputs Signal Timing (FEC_CRS and FEC_COL)
Table 20
lists MII asynchronous inputs signal timing.
Figure 24
shows MII asynchronous input timings listed in
Table 20
.
Figure 24. MII Async Inputs Timing Diagram
5.14.4 MII Serial Management Channel Timing (FEC_MDIO and
FEC_MDC)
Table 21
lists MII serial management channel timings. The FEC functions correctly with a maximum
MDC frequency of 2.5 MHz.
Table 20. MII Async Inputs Signal Timing
Num
Characteristic
Min
Max
Unit
M9
FEC_CRS, FEC_COL minimum pulse width
1.5
—
FEC_TXCLK period
Table 21. MII Serial Management Channel Timing
Num
Characteristic
Min
Max
Unit
M10
FEC_MDC falling edge to FEC_MDIO output invalid (minimum
propagation delay)
0
—
ns
M11
FEC_MDC falling edge to FEC_MDIO output valid (max prop delay)
—
25
ns
M12
FEC_MDIO (input) to FEC_MDC rising edge setup
10
—
ns
M13
FEC_MDIO (input) to FEC_MDC rising edge hold
0
—
ns
M6
FEC_TXCLK (input)
FEC_TXD[3:0] (outputs)
FEC_TXEN
FEC_TXER
M5
M7
M8
FEC_CRS
FEC_COL
M9
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PDF描述
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