參數資料
型號: MCF5232CAB80
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 32-BIT, 80 MHz, RISC PROCESSOR, PQFP160
封裝: QFP-160
文件頁數: 66/76頁
文件大?。?/td> 2665K
代理商: MCF5232CAB80
MOTOROLA
MCF523x Integrated Microprocessor Hardware Specifications
69
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
JTAG and Boundary Scan Timing
The values in Table 58 correspond to Figure 23.
Figure 23. QSPI Timing
6.13 JTAG and Boundary Scan Timing
Table 59. JTAG and Boundary Scan Timing
Num
Characteristics 1
1
JTAG_EN is expected to be a static signal. Hence, specific timing is not associated with it.
Symbol
Min
Max
Unit
J1
TCLK Frequency of Operation
fJCYC
DC
1/4
fsys/2
J2
TCLK Cycle Period
tJCYC
4
-
tCYC
J3
TCLK Clock Pulse Width
tJCW
26
-
ns
J4
TCLK Rise and Fall Times
tJCRF
0
3
ns
J5
Boundary Scan Input Data Setup Time to TCLK Rise
tBSDST
4
-
ns
J6
Boundary Scan Input Data Hold Time after TCLK Rise
tBSDHT
26
-
ns
J7
TCLK Low to Boundary Scan Output Data Valid
tBSDV
0
33
ns
J8
TCLK Low to Boundary Scan Output High Z
tBSDZ
0
33
ns
J9
TMS, TDI Input Data Setup Time to TCLK Rise
tTAPBST
4
-
ns
J10
TMS, TDI Input Data Hold Time after TCLK Rise
tTAPBHT
10
-
ns
J11
TCLK Low to TDO Data Valid
tTDODV
0
26
ns
J12
TCLK Low to TDO High Z
tTDODZ
0
8
ns
J13
TRST Assert Time
tTRSTAT
100
-
ns
J14
TRST Setup Time (Negation) to TCLK High
tTRSTST
10
-
ns
QSPI_CS[1:0]
QSPI_CLK
QSPI_DOUT
QS5
QS1
QSPI_DIN
QS3
QS4
QS2
相關PDF資料
PDF描述
MCF5232CVM100 32-BIT, 100 MHz, RISC PROCESSOR, PBGA196
MCF5271CVM150 32-BIT, 150 MHz, RISC PROCESSOR, PBGA196
MCF5270AB100 32-BIT, 100 MHz, RISC PROCESSOR, PQFP160
MCF5272CVF66 32-BIT, 66 MHz, RISC PROCESSOR, PBGA196
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相關代理商/技術參數
參數描述
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