參數(shù)資料
型號： MC705L16CFUE
廠商： Freescale Semiconductor
文件頁數(shù)： 3/146頁
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描述： IC MCU 8BIT EPROM 80-QFP
標準包裝： 84
系列： HC05
核心處理器： HC05
芯體尺寸： 8-位
速度： 2.1MHz
連通性： SPI
外圍設(shè)備： LCD，POR，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 16KB（16K x 8）
程序存儲器類型： OTP
RAM 容量： 512 x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 托盤
LCD Driver
MC68HC05L16 MC68HC705L16 Data Sheet, Rev. 4.1
100
Freescale Semiconductor
10.5 LCD Control Register
LCDE — LCD Output Enable
The LCDE bit enables all BP and FP outputs. (This bit does not affect PEH, PEL, or PDH bits.) This
bit is cleared on reset.
0 = All dedicated FP pins output highest (V
DD) level; BP and FP pins are shared with an output port
data.
1 = All BP and FP pins output LCD waveforms.
DUTY1 and DUTY0 — LCD Duty Select
The DUTY1 and DUTY0 bits select the duty of the LCD driver. The number of BP pins is related to this
duty selection. The unused BP pin is used as a port D pin. Default duty is 1/4 duty. These bits are
cleared on reset. See Table 10-1.
Bit 4 — Reserved
This bit is not used and always reads as logic 0.
PEH — Select Port E (H)
The PEH bit enables the upper four bits of port E instead of LCD drivers. This bit is cleared on reset.
0 = FP27–FP30 selected
1 = PE7–PE4 selected
PEL — Select Port E (L)
The PEL bit enables the lower four bits of port E instead of LCD drivers. This bit is cleared on reset.
0 = FP31–FP34 selected
1 = PE3–PE0 selected
PDH — Select Port D (H)
The PDH bit enables the upper four bits of port D instead of LCD drivers. This bit is cleared on reset.
0 = FP35–FP38 selected
1 = PD7–PD4 selected
Bit 0 — Reserved
This bit is not used and is always read as logic 0.
Address:
$0020
Bit 7
654321
Bit 0
Read:
LCDE
DUTY1
DUTY0
0
PEH
PEL
PDH
0
Write:
Reset:
00000000
Figure 10-5. LCD Control Register (LCDCR)
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PDF描述
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參數(shù)描述
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