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參數(shù)資料
| 型號(hào)： | MC68HC05J1AVP |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 66/128頁 |
| 文件大?。?/td> | 1620K |
| 代理商： | MC68HC05J1AVP |
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Technical Data
MC68HC05J1A — Rev. 3.0
66
Parallel Input/Output (I/O)
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
Parallel Input/Output (I/O)
When a port A pin is programmed as an output, reading the port bit
actually reads the value of the data latch and not the voltage on the pin
itself. When a port A pin is programmed as an input, reading the port bit
reads the voltage level on the pin. The data latch can always be written,
regardless of the state of its DDR bit.
Table 7-1
summarizes the
operations of the port A pins.
Table 7-1. Port A Pin Functions
Pulldown
Mask
Option
Control Bits
I/O Pin
Mode
Accesses
to PDRA
Accesses
to DDRA
Accesses
to PORTA
PDIAx
DDRAx
Read
Write
Read/Write
Read
Write
No
X
(1)
0
Input,
hi-z
U
(2)
PDIA7–PDIA0 DDRA7–DDRA0
Pin
PA7–PA0
No
X
1
Output
U
PDIA7–PDIA0 DDRA7–DDRA0
PA7–PA0
PA7–PA0
Yes
0
0
Input,
pulldown on
U
PDIA7–PDIA0 DDRA7–DDRA0
Pin
PA7–PA0
Yes
0
1
Output,
pulldown on
U
PDIA7–PDIA0 DDRA7–DDRA0
PA7–PA00
PA7–PA0
Yes
1
0
Input,
hi-z
U
PDIA7–PDIA0 DDRA7–DDRA0
Pin
PA7–PA0
Yes
1
1
Output
U
PDIA7–PDIA0 DDRA7–DDRA0
PA7–PA0
PA7–PA0
1. X = Don’t care
2. U = Undefined
F
Freescale Semiconductor, Inc.
n
.
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