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參數資料
| 型號： | MC68EZ328ZC16V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROPROCESSOR, PBGA144 |
| 封裝： | 13 X 13 MM, 1 MM PITCH, PLASTIC, BGA-144 |
| 文件頁數： | 180/246頁 |
| 文件大?。?/td> | 2507K |
| 代理商： | MC68EZ328ZC16V |
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Signal Descriptions
MOTOROLA
MC68EZ328 USERS MANUAL
2-7
2.8 LCD CONTROLLER SIGNALS
LD[3:0]/PC[3:0]LCD Data Bus Bits 3-0 and Port C Bits 3-0. This output bus transfers
pixel data to the LCD panel that it will be displayed on. The pixel data is arranged to
accommodate the programmable panel mode data width selection. Panel interfaces of
one, two, or four bits are supported. You can also program the output pixel data to be
inverted if it is required by your LCD panel.
The MC68EZ328s LCD interface data bus uses LD0 to display pixel 0, 0. Some LCD
panel manufacturers program their LCD panel data bus so that data bit 3 of the panel
displays pixel 0,0. For these panels, the connection between the MC68EZ328s LCD
data bus and the LCD panels data bus could have a reversed bit significance. For these
panels, you must connect the MC68EZ328s LD0 signal to the LCD panels data bit 3,
then connect LD1 to LCD data 2, LD2 to LCD data 1, and LD3 to LCD data 0. The four
pins can also be programmed as I/O ports from Port C. This pin defaults to a PCx input
signal pulled low.
LFLM/PC4First Line Marker and Port C Bit 4. This signal indicates the start of a new
display frame. LFLM becomes active after the first line pulse of the frame and remains
active until the next line pulse, at which point it deasserts and remains inactive until the
next frame. LFLM can be programmed to be an active-high or an active-low signal. It
can also be programmed as an I/O port.
LLP/PC5LCD Line Pulse and Port C Bit 5. This signal latches a line of shifted data
onto the LCD panel. It becomes active when a line of pixel data is clocked into the LCD
panel and remains asserted for eight pixel clock periods. LLP can be programmed to
be either an active-high or active-low signal. This pin can also be programmed as an
I/O port.
LCLK/PC6LCD Shift Clock and Port C Bit 6. This is the clock output to which the
output data to the LCD panel is synchronized. LCLK can be programmed to be either
an active-high or an active-low signal. This pin can also be programmed as an I/O port.
LACD/PC7LCD Alternate Crystal Direction and Port C Bit 7. This output is toggled to
alternate the crystal polarization on the panel. This signal can be programmed to toggle
at a period of 1 to 16 frames. This pin also can also be programmed as an I/O port.
LCONTRAST/PF0LCD Contrast and Port F Bit 0. This output controls the
pulse-width modulator (PWM) inside the LCD controller to adjust the supply voltage to
the LCD panel. This pin can also be programmed as an I/O port. This pin defaults to a
PFx input signal pulled high.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68EZ328PU16V | MICROPROCESSOR, PQFP100 |
| MC68HC(9)08EB8MFA | 8-BIT, 8.4 MHz, MICROCONTROLLER, PQFP32 |
| MC68HC(9)08EB8VFA | 8-BIT, 8.4 MHz, MICROCONTROLLER, PQFP32 |
| MC68HC(9)08EB8CFN | 8-BIT, 8.4 MHz, MICROCONTROLLER, PQCC44 |
| MC68HC(9)08EB8VFN | 8-BIT, 8.4 MHz, MICROCONTROLLER, PQCC44 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68F333 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:USER MANUAL |
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