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參數(shù)資料
| 型號： | MC68711E20VFNE2 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 61/138頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 52-PLCC |
| 標準包裝： | 23 |
| 系列： | HC11 |
| 核心處理器： | HC11 |
| 芯體尺寸： | 8-位 |
| 速度： | 4MHz |
| 連通性： | SCI，SPI |
| 外圍設備： | POR，WDT |
| 輸入/輸出數(shù)： | 38 |
| 程序存儲器容量： | 20KB（20K x 8） |
| 程序存儲器類型： | OTP |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 768 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 52-LCC（J 形引線） |
| 包裝： | 管件 |
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Memory Map
MC68HC711D3 Data Sheet, Rev. 2.1
Freescale Semiconductor
29
2.3.2 RAM and I/O Mapping Register
The random-access memory (RAM) and input/output (I/O) mapping register (INIT) is a special-purpose
8-bit register that is used during initialization to change the default locations of RAM and control registers
within the MCU memory map. It can be written to only once within the first 64 E-clock cycles after a reset
in normal modes. Thereafter, it becomes a read-only register.
$003A
Arm/Reset COP Timer Circuitry
Register (COPRST)
Read:
Bit 7Bit 6
Bit 5Bit 4Bit 3
Bit 2Bit 1Bit 0
Write:
Reset:
00
000
$003B
PROM Programming Control
Register (PPROG)
Read:
MBE
0
ELAT
EXCOL
EXROW
0
PGM
Write:
Reset:
00
000
$003C
Highest Priority I-Bit Interrupt and
Miscellaneous Register (HPRIO)
Read:
RBOOT
SMOD
MDA
IRVNE
PSEL3
PSEL2
PSEL1
PSEL0
Write:
Reset:
Note 1
0
1
0
1
1. The values of the RBOOT, SMOD, IRVNE, and MDA bits at reset depend on the mode during initialization. Refer to
$003D
RAM and I/O Mapping Register
(INIT)
Read:
RAM3
RAM2
RAM1
RAM0
REG3
REG2
REG1
REG0
Write:
Reset:
00
000
001
$003E
Test 1 Register
(TEST)
Read:
TILOP
0
OCC4
CBYP
DISR
FCM
FCOP
0
Write:
Reset:
00
000
$003F
System Configuration Register
(CONFIG)
Read:
00
000
NOCOP
ROMON
0
Write:
Reset:
00
000
U
0
Address:
$003D
Bit 7
654321
Bit 0
Read:
RAM3
RAM2
RAM1
RAM0
REG3
REG2
REG1
REG0
Write:
Reset:
00000000
Figure 2-3. RAM and I/O Mapping Register (INIT)
Addr.
Register Name
Bit 7
6
543
21
Bit 0
= Unimplemented
R
= Reserved
U = Unaffected
Figure 2-2. Register and Control Bit Assignments (Sheet 5 of 5)
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PDF描述 |
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參數(shù)描述 |
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