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參數(shù)資料
| 型號： | MB91V301CR-ESE1 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 68 MHz, RISC MICROCONTROLLER, CPGA179 |
| 封裝： | CERAMIC, PGA-179 |
| 文件頁數(shù)： | 19/139頁 |
| 文件大?。?/td> | 1482K |
| 代理商： | MB91V301CR-ESE1 |
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MB91301 Series
115
(8) SDRAM Timing
(VCC
= 3.0 V to 3.6 V , VSS = AVSS = 0 V, Ta = 0 °C to +70 °C)
Parameter
Symbol
Pin name
Condi-
tion
Value
Unit
Remarks
Min
Max
Output clock cycle time
tCYCSD
MCLK
68
MHz
“H” level clock pulse width
tCHSD
5
ns
“L” level clock pulse width
tCLSD
5
ns
MCLKO
↑→ output delay
time
tODSDCKE
MCLKE
11
ns
Output hold time
tOHSDCKE
2
ns
MCLKO
↑→ output delay
time
tODSDRAS
SRAS
11
ns
Output hold time
tOHSDRAS
2
ns
MCLKO
↑→ output delay
time
tODSDCAS
SCAS
11
ns
Output hold time
tOHSDCAS
2
ns
MCLKO
↑→ output delay
time
tODSDWE
SWE
11
ns
Output hold time
tOHSDWE
2
ns
MCLKO
↑→ output delay
time
tODSDCS
CS6, CS7
11
ns
Output hold time
tOHSDCS
2
ns
MCLKO
↑→ output delay
time
tODSDA
A00 to A15
11
ns
Output hold time
tOHSDA
2
ns
MCLKO
↑→ output delay
time
tODSDDQM
DQMUU,
DQMUL,
DQMLU,
DQMLL
11
ns
Output hold time
tOHSDDQM
2
ns
MCLKO
↑→ output delay
time
tODSDD
D00 to D31
11
ns
Output hold time
tOHSDD
2
ns
Data input setup time
tISSDD
D00 to D31
4
ns
Data input hold time
tIHSDD
2
ns
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PDF描述 |
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