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參數(shù)資料
| 型號： | MB91V108PFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP120 |
| 封裝： | 16 X 16 MM, 0.50 MM PITCH, PLASTIC, LQFP-120 |
| 文件頁數(shù)： | 396/454頁 |
| 文件大?。?/td> | 6395K |
| 代理商： | MB91V108PFV |
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30
CHAPTER 3 CPU
Figure 3.2-2 Instruction Pipeline
Instructions are executed sequentially. For example, if instruction A enters the pipeline before
instruction B, instruction A reaches the write back stage before instruction B.
As a rule, instructions are executed at a speed of one instruction per cycle. However, load and
store instructions that involve memory wait, branch instructions that do not have delay slots, and
multiple cycle instructions will require several cycles to execute. In addition, if the supply of
instructions is delayed, the execution speed of the instructions will be reduced.
See Section 3.9 "Overview of Instructions" for details on instructions.
r Instruction cache
The on-chip instruction cache can be used to create a high-performance system without having
high-speed external memory and without incurring high costs for control logic.
Even if the
external bus is slow, instructions can be issued to the CPU at high speed.
See Section 3.3 "Instruction Cache" for details on the instruction cache.
r 32-bit <-- --> 16-bit bus converter
This converter acts as interface between the D-BUS for high-speed 32-bit access and the R-
BUS for 16-bit access and enables the accesses from the CPU to the built-in circuits for
peripherals.
The converter converts 32-bit accesses from the CPU into two 16-bit accesses and performs
the access over the R-BUS. Some of the built-in circuits for peripherals are limited with respect
to their access width.
r Harvard <-- --> Princeton bus converter
The Harvard <-- --> Princeton bus converter adjusts CPU instruction access and data access to
ensure efficient interfacing with the external bus.
The CPU employs Harvard architecture, in which the instruction and data buses are
independent. The bus controller that controls the external bus employs Princeton architecture,
in which opnly a single bus is used. The Harvard <-- --> Princeton bus converter assigns an
access priority for instruction access and data access to control access to the bus controller,
thereby optimizing the order of external access.
Moreover, the bus converter has a two-word write buffer to eliminate the CPU bus wait time and
a one-word prefetch buffer to prefetch instructions.
Instruction 1
WB
MA
WB
EX
MA
WB
ID
EX
MA
WB
IF
ID
EX
MA
WB
IF
ID
EX
MA
WB
Instruction 2
Instruction 3
Instruction 4
Instruction 5
Instruction 6
CLK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB95F108AKSPFM | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95F108AKSPFV | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95F108AKWPFV | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MB95R203P-G-SH-JNE2 | MICROCONTROLLER, PDIP24 |
| MB95R203PF-G-JNE2 | MICROCONTROLLER, PDSO20 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB91V110 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-Bit RISC Microcontroller |
| MB91V210 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Proprietary Microcontroller |
| MB91V210PB-ESE1 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Proprietary Microcontroller |
| MB91V220 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
| MB91V220ACR-ES | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:32-bit Microcontroller |
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