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參數(shù)資料
| 型號： | MB89P935APFV |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 10 MHz, MICROCONTROLLER, PDSO30 |
| 封裝： | 0.65 MM PITCH, PLASTIC, SSOP-30 |
| 文件頁數(shù)： | 249/417頁 |
| 文件大小： | 5980K |
| 代理商： | MB89P935APFV |
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308
CHAPTER 13 UART
13.5 Interrupt of UART
UART supports the interrupt-related error flag bit (ORFE), received data flag bit
(RDRF), and transmitted data flag bit (TDRE), and the following interrupt sources:
When received data is sent from the reception shift register to the serial input data
register (SIDR). (Reception interrupt)
When transmitted data is sent from the serial output data register (SODR) to the
transmission shift register. (Transmission interrupt)
s Transmission Interrupt
When the SSD register is read and the output data is written into the SODR register, the data
written into the SODR register is transferred to the internal transmission shift register. When
next data becomes writable, the TDRE bit is set to 1, then an interrupt request to the CPU
(IRQ5) is generated if the transmission interrupt is enabled (SSD: TIE = 1).
s Reception Interrupt
r When operating mode is 0, 1, or 3
When data is correctly input up to the stop bit, the RDRF bit is set to 1. If an over-run error or
framing error occurs, the ORFE bit is set to 1.
These bits are set when a stop bit is detected. If the reception interrupt is enabled (SSD: RIE =
1), an interrupt request to the CPU (IRQ6) is generated.
r When operating mode is 2
For both RDRF and ORFE, data is received or transmitted with the final data bit (D8) set to 1, its
flag goes on when the stop bit at the end is detected. However, when the framing error occurs,
the flag goes on regardless of the final data bit. An interrupt request to the CPU is generated
when the flag goes on and the input data becomes 1.
s UART Interrupt Related Registers and Vector Table Addresses
Table 13.5-1 "UART Interrupt Related Registers and Vector Table Addresses" provides the
registers relating to the UART interrupts and vector table addresses. For details of the interrupt
operation, see Section 3.4.2 "Steps in the Interrupt Operation".
Table 13.5-1 UART Interrupt Related Registers and Vector Table Addresses
Interrupt name
Interrupt level setting register
Vector table address
Register
Bit
Upper digits
Lower digits
IRQ5
ILR2 (007CH)
L51 (bit3)
L50 (bit2)
FFEEH
FFEFH
IRQ6
ILR2 (007CH)
L61 (bit5)
L60 (bit4)
FFF0H
FFF1H
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB89P935BPFV | 8-BIT, OTPROM, 10 MHz, MICROCONTROLLER, PDSO30 |
| MB89935BPFV | 8-BIT, MROM, 10 MHz, MICROCONTROLLER, PDSO30 |
| MB89PV930ACFV | 8-BIT, 10 MHz, MICROCONTROLLER, CQFP48 |
| MB89PV190A-201CF | 8-BIT, 4.2 MHz, MICROCONTROLLER, CQFP48 |
| MB89P195A-201P | 8-BIT, OTPROM, 4.2 MHz, MICROCONTROLLER, PDIP28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MB89P935B | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P935BPFV | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P945 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P945PF | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P955 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
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