參數(shù)資料
型號： MAX19713ETN
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 通信及網(wǎng)絡
英文描述： 10-Bit, 45Msps, Full-Duplex Analog Front-End
中文描述： SPECIALTY TELECOM CIRCUIT, QCC56
封裝： 7 X 7 MM, 0.80 MM HEIGHT, MO-220, TQFN-56
文件頁數(shù)： 6/37頁
文件大?。?/td> 892K
代理商： MAX19713ETN
M
10-Bit, 45Msps, Full-Duplex
Analog Front-End
6
_______________________________________________________________________________________
ELECTRICAL CHARACTERISTICS (continued)
(V
DD
= 3V, OV
DD
= 1.8V, internal reference (1.024V), C
L
≈
10pF on all digital outputs, f
CLK
= 45MHz (50% duty cycle), Rx ADC input amplitude
= -0.5dBFS, Tx DAC output amplitude = 0dBFS, CM1 = 0, CM0 = 0, differential Rx ADC input, differential Tx DAC output, C
REFP
= C
REFN
=
C
COM
= 0.33μF, C
L
< 5pF on all aux-DAC outputs, T
A
= T
MIN
to T
MAX
, unless otherwise noted. Typical values are at T
A
= +25°C.) (Note 1)
PARAMETER
SYMBOL
INL
CONDITIONS
MIN
TYP
±0.6
210
MAX
UNITS
LSB
μA
Integral Nonlinearity
Supply Current
AUXILIARY DACs (DAC1, DAC2, DAC3)
Resolution
Integral Nonlinearity
N
12
Bits
LSB
INL
From code 100 to code 4000
±1.25
Differential Nonlinearity
DNL
Guaranteed monotonic over code 100 to
code 4000 (Note 6)
R
L
> 200k
Ω
R
L
> 200k
Ω
DC output at midscale
-1.0
±0.65
+1.2
LSB
Output-Voltage Low
Output-Voltage High
DC Output Impedance
V
OL
V
OH
0.2
V
V
Ω
2.57
4
Settling Time
From code 1024 to code 3072, within ±10
LSB
1
μs
Glitch Impulse
Rx ADC–Tx DAC TIMING CHARACTERISTICS
CLK Rise to Channel-I Output Data
Valid
From code 0 to code 4095
24
nV
s
t
DOI
Figure 3 (Note 6)
5.5
8.2
12.5
ns
CLK Fall to Channel-Q Output
Data Valid
t
DOQ
Figure 3 (Note 6)
6.5
9.5
13.6
ns
I- D AC D ATA to C LK Fal S etup Ti m e
t
D S
Fi g ur e 5 ( N ote 6)
10
ns
Q-DAC DATA to CLK Rise Setup
Time
t
DSQ
Figure 5 (Note 6)
10
ns
CLK Fall to I-DAC Data Hold Time
t
DHI
Figure 5 (Note 6)
0
ns
CLK Rise to Q-DAC Data Hold
Time
t
DHQ
Figure 5 (Note 6)
0
ns
CLK Duty Cycle
CLK Duty-Cycle Variation
Digital Output Rise/Fall Time
SERIAL-INTERFACE TIMING CHARACTERISTICS (Figures 6 and 8, Note 6)
Falling Edge of
CS
/WAKE to Rising
Edge of First SCLK Time
50
±10
2.4
%
%
ns
20% to 80%
t
CSS
10
ns
DIN to SCLK Setup Time
DIN to SCLK Hold Time
SCLK Pulse-Width High
SCLK Pulse-Width Low
SCLK Period
SCLK to
CS
/WAKE Setup Time
CS
/WAKE High Pulse Width
t
DS
t
DH
t
CH
t
CL
t
CP
t
CS
t
CSW
10
0
25
25
50
10
80
ns
ns
ns
ns
ns
ns
ns
CS
/WAKE High to DOUT Active
High
t
CSD
Bit AD0 set
200
ns
相關PDF資料
PDF描述
MAX2003A Fast-Charge Battery Chargers(NICD/NIMH,可充電池數(shù)1~16個,電池快速充電器)
MAX2021ETX High-Dynamic-Range, Direct Up-/Downconversion 750MHz to 1200MHz Quadrature Mod/Demod
MAX2021ETX-T High-Dynamic-Range, Direct Up-/Downconversion 750MHz to 1200MHz Quadrature Mod/Demod
MAX2021 1700MHz to 2200MHz High-Linearity, SPI-Controlled DVGA with Integrated Loopback Mixer
MAX2023 1700MHz to 2200MHz High-Linearity, SPI-Controlled DVGA with Integrated Loopback Mixer
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參數(shù)描述
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MAX19713ETN+TGH7 功能描述:ADC / DAC多通道 10-Bit 45Msps Full-Duplex Analog Front-End RoHS:否 制造商:Texas Instruments 轉換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:VQFN-40
MAX19713ETN-T 功能描述:ADC / DAC多通道 RoHS:否 制造商:Texas Instruments 轉換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:VQFN-40
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