參數(shù)資料
型號： M7536
廠商： Mitsubishi Electric Corporation
英文描述： 8-Bit Single-Chip Microcomputer(8位單片微控制器)
中文描述： 8位單片機（8位單片微控制器）
文件頁數(shù)： 9/225頁
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代理商： M7536
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7532/7536 Group User’s Manual
v
Fig. 46 Programming and testing of One Time PROM version ............................................1-40
Fig. 47 Timing chart after an interrupt occurs .........................................................................1-42
Fig. 48 Time up to execution of the interrupt processing routine ........................................1-42
Fig. 49 A-D conversion equivalent circuit.................................................................................1-44
Fig. 50 A-D conversion timing chart..........................................................................................1-44
Fig. 51 Pin configuration of M37532M4-XXXFP, M37532E8FP ............................................1-49
Fig. 52 Pin configuration of M37532M4-XXXGP......................................................................1-49
Fig. 53 Pin configuration of M37532RSS .................................................................................1-50
Fig. 54 Handling of V
CC
, USBV
REFOUT
pins of M37532M4-XXXFP, M37532E8FP ................1-51
Fig. 55 Handling of V
CC
, USBV
REFOUT
pins of M37532M4-XXXGP .........................................1-52
Fig. 56 Handling of V
CC
, USBV
REFOUT
pins of M37536E8SP, M37536M4-XXXSP, M37536RSS,
M37532RSS .....................................................................................................................1-53
CHAPTER 2 APPLICATION
Fig. 2.1.1 Memory map of registers relevant to I/O port .........................................................2-2
Fig. 2.1.2 Structure of Port Pi (i = 0 to 4).................................................................................2-2
Fig. 2.1.3 Structure of Port Pi direction register (i = 0 to 4) .................................................. 2-3
Fig. 2.1.4 Structure of Pull-up control register .......................................................................... 2-3
Fig. 2.1.5 Structure of P1P3 control register .............................................................................2-4
Fig. 2.1.6 Structure of Interrupt edge selection register ..........................................................2-4
Fig. 2.1.7 Structure of Interrupt request register 1 ................................................................... 2-5
Fig. 2.1.8 Structure of Interrupt control register 1 .................................................................... 2-5
Fig. 2.1.9 Relevant registers setting ...........................................................................................2-6
Fig. 2.1.10 Application circuit example .......................................................................................2-6
Fig. 2.1.11 Control procedure.......................................................................................................2-7
Fig. 2.2.1 Memory map of registers relevant to timers ..........................................................2-10
Fig. 2.2.2 Structure of Prescaler 12, Prescaler X ...................................................................2-10
Fig. 2.2.3 Structure of Timer 1 ..................................................................................................2-11
Fig. 2.2.4 Structure of Timer 2 ..................................................................................................2-11
Fig. 2.2.5 Structure of Timer X ..................................................................................................2-12
Fig. 2.2.6 Structure of Timer X mode register.........................................................................2-13
Fig. 2.2.7 Structure of Timer count source set register .........................................................2-14
Fig. 2.2.8 Structure of Interrupt edge selection register ........................................................2-14
Fig. 2.2.9 Structure of Interrupt request register 1 .................................................................2-15
Fig. 2.2.10 Structure of Interrupt control register 1 ................................................................2-15
Fig. 2.2.11 Timers connection and setting of division ratios .................................................2-17
Fig. 2.2.12 Relevant registers setting .......................................................................................2-18
Fig. 2.2.13 Control procedure.....................................................................................................2-19
Fig. 2.2.14 Peripheral circuit example.......................................................................................2-20
Fig. 2.2.15 Timers connection and setting of division ratios .................................................2-20
Fig. 2.2.16 Relevant registers setting .......................................................................................2-21
Fig. 2.2.17 Control procedure.....................................................................................................2-22
Fig. 2.2.18 Judgment method of valid/invalid of input pulses ...............................................2-23
Fig. 2.2.19 Relevant registers setting .......................................................................................2-24
Fig. 2.2.20 Control procedure.....................................................................................................2-25
Fig. 2.2.21 Timers connection and setting of division ratios .................................................2-26
Fig. 2.2.22 Relevant registers setting .......................................................................................2-27
Fig. 2.2.23 Control procedure.....................................................................................................2-28
Fig. 2.3.1 Memory map of registers relevant to serial I/O.....................................................2-29
Fig. 2.3.2 Structure of Transmit/Receive buffer register ........................................................2-29
Fig. 2.3.3 Structure of UART status register ...........................................................................2-30
Fig. 2.3.4 Structure of Serial I/O1 control register..................................................................2-30
Fig. 2.3.5 Structure of UART control register ..........................................................................2-31
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