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參數(shù)資料
| 型號(hào)： | LSIFC909 |
| 英文描述： | LSIFC909 Fibre Channel I/O Processor technical manual v2.1 8/00 |
| 中文描述： | LSIFC909光纖通道I / O處理器技術(shù)手冊(cè)2.1 8 / 00 |
| 文件頁(yè)數(shù)： | 80/144頁(yè) |
| 文件大?。?/td> | 1496K |
| 代理商： | LSIFC909 |
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5-24
Registers
the Host Interface register set. I/O write/read transactions are not
expected to be utilized during normal usage of the LSIFC909 design;
they are included as a result of using the UPI-64 PCI core.
Register: 0x00
System Doorbell
Read/Write
The
System Doorbell
register is a simple message passing mechanism
to allow the System to pass single word messages to the embedded IOP
and vice versa. When a PCI master writes to the HostRegs->Doorbell
register, a maskable interrupt is generated to the IOP. The value written
by the System master is available for the IOP to read in the
SysIfRegs->Doorbell register. The interrupt status will be cleared when
the IOP writes any value to the SysIfRegs->DoorbellClear register.
Conversely, when the IOP writes to the SysIfRegs->Doorbell register, a
maskable interrupt is generated to the PCI system using the INTA/ signal
Table 5.3
Host Interface Register Map
31
16 15
0
System Doorbell Register
Write Sequence Register
0x00
0x04
Host Diagnostic Register
Test Base Address Register
Reserved
Host Interrupt Status Register
Host Interrupt Mask Register
Reserved
Request FIFO
Reply FIFO
Reserved
Host Index Register
Reserved
0x08
0x0C
0x10–0x2F
0x30
0x34
0x38–0x3F
0x40
0x44
0x48–0x4F
0x50
0x54–0x7F
31
16
HDV (Most Significant)
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
15
0
HDV (Least Significant)
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
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