參數(shù)資料
型號： LH79520N0Q000B1
廠商： NXP Semiconductors N.V.
元件分類： 數(shù)學處理器
英文描述： System-on-Chip
封裝： LH79520N0Q000B1<SOT1017-1 (LQFP176)|<<http://www.nxp.com/packages/SOT1017-1.html<1<Always Pb-free,;
文件頁數(shù)： 37/59頁
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代理商： LH79520N0Q000B1
System-on-Chip
LH79520
Preliminary data sheet
Rev. 01
—
16 July 2007
37
NXP Semiconductors
SDRAM Memory Controller Waveforms
Figure 16 shows the waveform and timing for an
SDRAM Burst Read (page already open). Figure 17
shows the waveform and timing for SDRAM to Activate
a Bank and Write.
Figure 16. SDRAM Burst Read
Figure 17. SDRAM Bank Activate and Write
t
SDCLK
LH79520-35
A[15:0]
D[31:0]
NOTES:
1. SDRAMcmd is the combination of nRAS, nCAS, nSDWE, and nSDCS(X).
2. tOVXXX represents tOVRA, tOVCA, tOVSDW, or tOVSC.
3. tOHXXX represents tOHRA, tOHCA, tOHSDW, or tOHSC.
4. nDQM is LOW.
5. SDCKE is HIGH.
SCLK
SDRAMcmd
t
OVXXX
t
OV
t
OHXXX
READ
BANK,
COLUMN
tOVA
tISD tIHD
DATA n
DATA n + 1
DATA n + 2
DATA n + 3
79520-36
D[31:0]
SCLK
SDCKE
SDRAMcmd
tSDCLK
tOVC0
tOVXXX
tOVA
tOHXXX
tOVA
NOTES:
1. SDRAMcmd is the combination of nRAS, nCAS, nSDWE, and nSDCS(X).
2. tOVXXX represents tOVRA, tOVCA, tOVSDW, or tOVSC. Refer to the AC timing table.
3. tOHXXX represents tOHRA, tOHCA, tOHSDW, or tOHSC.
4. nDQM is LOW.
ACTIVE
WRITE
DATA
BANK,
ROW
BANK,
COLUMN
tOVD
tOHD
A[15:0]
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PDF描述
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LH79525N0Q100A1 System-on-Chip
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參數(shù)描述
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LH79520N0Q000B155 制造商:Rochester Electronics LLC 功能描述: 制造商:NXP 功能描述: 制造商:NXP Semiconductors 功能描述:
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