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參數(shù)資料
| 型號(hào)： | L80223 |
| 廠商： | LSI CORP |
| 元件分類(lèi)： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁(yè)數(shù)： | 110/192頁(yè) |
| 文件大?。?/td> | 1306K |
| 代理商： | L80223 |
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Draft 6/5/00
5-2
Management Interface
Copyright 2000 by LSI Logic Corporation. All rights reserved.
5.1 Signal Description
The MI serial port has eight pins:
MDC: serial shift clock input pin
MDIO: bidirectional data pin
MDINTn: interrupt pin
MDA[4:0]n: physical address pins
The MDA[4:0]n pins configure the device for a particular address, from
0b0000 to 0b1111, such that 16 devices can exist in the same address
domain, and each be addressed separately over the MI serial port. When
an MI read or write cycle occurs, the device compares the internally
inverted and latched state of the MDA[4:0]n pins to the PHYAD[4:0]
address bits of the MI frame. If the states compare, the device knows it
is being addressed.
The MDA[4:0]n inputs share the same pins as the MDINTn and
PLED[3:0]n outputs, respectively. At powerup or reset, the PLED[3:0]n
and MDINTn output drivers are 3-stated for an interval called the
power-on reset time. During the power-on reset interval, the value on
these pins is latched into the device, inverted, and used as the MI serial
port physical device addresses.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L80600 | L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01 |
| L811-1X1T-03 | 1port.None LEDs.low profile RJ45 10/100Base-TX |
| L82-510 | Logic IC |
| L82-511 | Logic IC |
| L82-512 | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L80223/A | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/C | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/D | 制造商:LSI Corporation 功能描述:PHY 1-CH 10Mbps/100Mbps 64-Pin LQFP |
| L80223/D-E6 | 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68032B1 - Bulk |
| L80223/D-LEADFREE | 制造商:LSI Corporation 功能描述: |
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