參數(shù)資料
型號(hào): KSZ8895RQI
廠商: Micrel Inc
文件頁(yè)數(shù): 42/119頁(yè)
文件大小: 0K
描述: IC 10/100-T 5 PORT SW 128PQFP
標(biāo)準(zhǔn)包裝: 66
系列: *
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)當(dāng)前第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)
2011-2012 Microchip Technology Inc.
Preliminary
DS41579C-page 29
PIC16(L)F1782/3
TABLE 3-8:
SPECIAL FUNCTION REGISTER SUMMARY
Addr
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Value on
all other
Resets
Bank 0
00Ch PORTA
PORTA Data Latch when written: PORTA pins when read
xxxx xxxx uuuu uuuu
00Dh PORTB
PORTB Data Latch when written: PORTB pins when read
xxxx xxxx uuuu uuuu
00Eh PORTC
PORTC Data Latch when written: PORTC pins when read
xxxx xxxx uuuu uuuu
00Fh —
Unimplemented
010h PORTE
—RE3
---- x--- ---- u---
011h PIR1
TMR1GIF
ADIF
RCIF
TXIF
SSP1IF
CCP1IF
TMR2IF
TMR1IF
0000 0000 0000 0000
012h PIR2
OSFIF
C2IF
C1IF
EEIF
BCL1IF
C3IF
CCP2IF
0000 0-00 0000 0-00
013h —
Unimplemented
014h PIR4
PSMC2TIF
PSMC1TIF
PSMC2SIF
PSMC1SIF --00 --00 --00 --00
015h TMR0
Timer0 Module Register
xxxx xxxx uuuu uuuu
016h TMR1L
Holding Register for the Least Significant Byte of the 16-bit TMR1 Register
xxxx xxxx uuuu uuuu
017h TMR1H
Holding Register for the Most Significant Byte of the 16-bit TMR1 Register
xxxx xxxx uuuu uuuu
018h T1CON
TMR1CS1
TMR1CS0
T1CKPS1
T1CKPS0
T1OSCEN
T1SYNC
—TMR1ON
0000 00-0 uuuu uu-u
019h T1GCON
TMR1GE
T1GPOL
T1GTM
T1GSPM
T1GGO/
DONE
T1GVAL
T1GSS1
T1GSS0
0000 0x00 uuuu uxuu
016h TMR2
Holding Register for the Least Significant Byte of the 16-bit TMR2 Register
xxxx xxxx uuuu uuuu
017h PR2
Holding Register for the Most Significant Byte of the 16-bit TMR2 Register
xxxx xxxx uuuu uuuu
018h T2CON
T2OUTPS<3:0>
TMR2ON
T2CKPS<1:0>
-000 0000 -000 0000
01Dh
to
01Fh
Unimplemented
Bank 1
08Ch TRISA
PORTA Data Direction Register
1111 1111 1111 1111
08Dh TRISB
PORTB Data Direction Register
1111 1111 1111 1111
08Eh TRISC
PORTC Data Direction Register
1111 1111 1111 1111
08Fh —
Unimplemented
090h TRISE
(2)
---- 1--- ---- 1---
091h PIE1
TMR1GIE
ADIE
RCIE
TXIE
SSP1IE
CCP1IE
TMR2IE
TMR1IE
0000 0000 0000 0000
092h PIE2
OSFIE
C2IE
C1IE
EEIE
BCL1IE
C3IE
CCP2IE
0000 0-00 0000 0-00
093h —
Unimplemented
094h PIE4
PSMC2TIE
PSMC1TIE
PSMC2SIE
PSMC2SIE --00 --00 --00 --00
095h OPTION_REG
WPUEN
INTEDG
TMR0CS
TMR0SE
PSA
PS2
PS1
PS0
1111 1111 1111 1111
096h PCON
STKOVF
STKUNF
—RWDT
RMCLR
RI
POR
BOR
00-1 11qq qq-q qquu
097h WDTCON
WDTPS4
WDTPS3
WDTPS2
WDTPS1
WDTPS0
SWDTEN
--01 0110 --01 0110
098h OSCTUNE
TUN5
TUN4
TUN3
TUN2
TUN1
TUN0
--00 0000 --00 0000
099h OSCCON
SPLLEN
IRCF3
IRCF2
IRCF1
IRCF0
SCS1
SCS0
0011 1-00 0011 1-00
09Ah OSCSTAT
T1OSCR
PLLR
OSTS
HFIOFR
HFIOFL
MFIOFR
LFIOFR
HFIOFS
00q0 --00 qqqq --0q
09Bh ADRESL
A/D Result Register Low
xxxx xxxx uuuu uuuu
09Ch ADRESH
A/D Result Register High
xxxx xxxx uuuu uuuu
09Dh ADCON0
CHS4
CHS3
CHS2
CHS1
CHS0
GO/DONE
ADON
-000 0000 -000 0000
09Eh ADCON1
ADFM
ADCS2
ADCS1
ADCS0
ADNREF
ADPREF1
ADPREF0
0000 -000 0000 -000
09Fh ADCON2
TRIGSEL3
TRIGSEL2
TRIGSEL1
TRIGSEL0
CHSN3
CHSN2
CHSN1
CHSN0
000- -000 000- -000
Legend:
x = unknown, u = unchanged, q = value depends on condition, - = unimplemented, read as ‘0’, r = reserved.
Shaded locations are unimplemented, read as ‘0’.
Note
1:
These registers can be addressed from any bank.
2:
Unimplemented, read as ‘1’.
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PDF描述
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參數(shù)描述
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