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參數(shù)資料
| 型號： | KIT33989DWEVB |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 42/72頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT EVAL 33989DW HS SBC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 接口，CAN 控制器 |
| 嵌入式： | 是，MCU，8 位 |
| 已用 IC / 零件： | MC33989 |
| 主要屬性： | CAN 2.0 系統(tǒng)基礎(chǔ)芯片（SBC），SPI 接口，2 低壓降穩(wěn)壓器 |
| 次要屬性： | 故障檢測，睡眠和待機(jī)模式 |
| 已供物品： | 板，CD |
| 相關(guān)產(chǎn)品： | MC33989DWR2CT-ND - IC SYSTEM BASE W/CAN 28-SOIC MC33989DWR2TR-ND - IC SYSTEM BASE W/CAN 28-SOIC MC33989DW-ND - IC SYSTEM BASE W/CAN 28-SOIC |
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Analog Integrated Circuit Device Data
Freescale Semiconductor
47
33989
TYPICAL APPLICATIONS
SUPPLEMENTAL APPLICATION NOTES
LX Wakes up SBC from Sleep Mode
Below is the case where the SBC is in sleep mode and is awaked by LX positive edge.
Figure 26. SBC in Sleep Mode
T1 (LX high level to VDD1 turn on): typ 100 s.
T2: VDD1 rising time is dependent on the capacitor and the load connected to VDD1. It can be approximated by the capacitor
charging time with the regulator output current limitation: T2 = (C x U)/I. With C = 100 mF, IDD1 = 200 mA min., U = 5.0 V
so T2 = 2.5 ms).
T3 (VDD1>RST-TH (4.6 V by default) to reset high): parameter Rest dur: 4.0 ms max.
The total time is 6.6 ms in this example.
CAN Wake-up
The following case describes the signal for CAN wake-up. Refer to page 53 for more details on CAN wake-up signals and the
TCAN analysis.
Figure 27. CAN Wake-up
T1(third valid CAN dominant pulse to VDD1 turn on): typ 80 s.
T2 and T3 identical to page 42 above
The total time is 6.58 ms in this example.
LX with Cyclic Sense
The case below is a description of the wake-up by LX input associated with the cyclic sense function.
Figure 28. Wake-up by LX Input
LX
VDD1
RST
t1
t3
t2
CAN
VDD1
RESET
t1
t2
t3
tCAN
RST
LX
VDD1
RESET
t2
t1
HS1
t3
t4
RST
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| KIT33999EKEVB | 功能描述:電源管理IC開發(fā)工具 33999 PDOSS EVAL KIT RoHS:否 制造商:Maxim Integrated 產(chǎn)品:Evaluation Kits 類型:Battery Management 工具用于評估:MAX17710GB 輸入電壓: 輸出電壓:1.8 V |
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