參數(shù)資料
型號(hào)： ICS853S013AMILF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 9/16頁
文件大?。?/td> 0K
描述： IC CLOCK BUFFER 1:3 2GHZ 20-SOIC
標(biāo)準(zhǔn)包裝： 74
類型： 扇出緩沖器（分配）
電路數(shù)： 2
比率 - 輸入:輸出： 1:3
差分 - 輸入:輸出： 是/是
輸入： CML，LVDS，LVPECL，SSTL
輸出： ECL，PECL
頻率 - 最大： 2GHz
電源電壓： 2.375 V ~ 3.8 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 20-SOIC
包裝： 管件
其它名稱： 800-2249
ICS853S013AMI REVISION A AUGUST 20, 2010
2
2010 Integrated Device Technology, Inc.
ICS853S013I Data Sheet
LOW SKEW, DUAL, 1-TO-3, DIFFERENTIAL-TO-2.5V, 3.3V LVPECL/ECL FANOUT BUFFER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Function Table
Table 3. Clock Input Function Table
NOTE 1: Please refer to the Application Information, Wiring the Differential Input to Accept Single Ended Levels.
Number
Name
Type
Description
1, 2
nQA0, QA0
Output
Differential output pair. LVPECL interface levels.
3, 8, 16
VCC
Power
Power supply pins.
4
PCLKA
Input
Pulldown
Non-inverting differential LVPECL clock input.
5
nPCLKA
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VCC/2 default when left floating.
6
PCLKB
Input
Pulldown
Non-inverting differential LVPECL clock input.
7
nPCLKB
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VCC/2 default when left floating.
9, 10
nQB0, QB0
Output
Differential output pair. LVPECL interface levels.
11
VEE
Power
Negative supply pin.
12, 13
nQB1, QB1
Output
Differential output pair. LVPECL interface levels.
14, 15
nQB2, QB2
Output
Differential output pair. LVPECL interface levels.
17, 18
nQA2, QA2
Output
Differential output pair. LVPECL interface levels.
19, 20
nQA1, QA1
Output
Differential output pair. LVPECL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
RPULLDOWN
Input Pulldown Resistor
75
k
RVCC/2
Pullup/Pulldown Resistors
50
k
Inputs
Outputs
Input to Output Mode
Polarity
PCLKA or PCLKB
nPCLKA or nPCLKB
QA[0:2],
QB[0:2]
nQA[0:2],
nQB[0:2]
0
1
LOW
HIGH
Differential to Differential
Non-Inverting
1
0
HIGH
LOW
Differential to Differential
Non-Inverting
0
Biased; NOTE 1
LOW
HIGH
Single-Ended to Differential
Non-Inverting
1
Biased; NOTE 1
HIGH
LOW
Single-Ended to Differential
Non-Inverting
Biased; NOTE 1
0
HIGH
LOW
Single-Ended to Differential
Inverting
Biased; NOTE 1
1
LOW
HIGH
Single-Ended to Differential
Inverting
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PDF描述
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