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參數(shù)資料
| 型號： | HMS30C7210 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | ARM Based 32-Bit Microprocessor |
| 中文描述： | 基于ARM的32位微處理器 |
| 文件頁數(shù)： | 61/161頁 |
| 文件大小： | 973K |
| 代理商： | HMS30C7210 |
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HMS30C7110
2003 MagnaChip Semiconductor Ltd. All Rights Reserved
Version 1.5
61
15:12 RW
0xf
RAS (Row Active Time)
This 4-bit field specifies the number of cycles guaranteed between an
activate command and a pre-charge command.
11: 8
RW
0xf
RC (Row Cycle Time)
This 4-bit field specifies the number of cycles for a refresh command. It
also specifies the number of cycles between bank activation commands
to the same bank.
7: 6
0x0
Reserved
5: 4
RW
0x7
CL (CAS Latency)
This value is used to program the SDRAM devices during the
Initialization sequence, and internally by the SDRAM controller.
0 = 1 clock
1 = 2 clocks
2 = 3 clocks
3 = Reserved
3: 2
0x0
Reserved
0
RW
0x1
Row Hit Enable
This value is used to enable the checking of the row address from
internal logic matched with row address of destination SDRAM. It may
cause one or two clock delay in accessing SDRAM but will make sure
that correct operation will be happening.
0 : Do not check whether row address is HIT or not.
1 : Check whether row address is HIT or not.
2.5.2.3.
Refresh Interval
This register includes refresh interval value and MCLK tuning control reginter.
Table 2.18 Refresh Interval
Address :
1908_0014
Bits
Access Default Description
31:29
0x0
Reserved.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| HMS3224M3 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
| HMS3224M3-10 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
| HMS3224M3-12 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
| HMS3224M3-15 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
| HMS3224M3-17 | 制造商:HANBIT 制造商全稱:Hanbit Electronics Co.,Ltd 功能描述:SRAM MODULE 768KBit (32K x 24-Bit) |
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