/FIFO IC <" />
參數(shù)資料
型號(hào)： FT2232D-REEL
廠商： FTDI, Future Technology Devices International Ltd
文件頁數(shù)： 3/61頁
文件大小： 0K
描述： IC USB FS DUAL UART/FIFO 48-LQFP
產(chǎn)品培訓(xùn)模塊： USB Introduction
標(biāo)準(zhǔn)包裝： 1
系列： USBmadeEZ-FIFO，F(xiàn)T-X，X-Chip
特點(diǎn)： USB 至 UART 和（或）FIFO、SPI、I2C、JTAG
通道數(shù)： 2，DUART
FIFO's： 384 字節(jié)
規(guī)程： RS232，RS422，RS485
電源電壓： 4.35 V ~ 5.25 V
帶并行端口： 是
帶自動(dòng)流量控制功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP
包裝： 標(biāo)準(zhǔn)包裝
產(chǎn)品目錄頁面： 634 (CN2011-ZH PDF)
配用： 768-1030-ND - MOD USB HS FT2232H EVAL
813-1009-ND - MODULE USB-TO-FPGA TOOL W/MANUAL
813-1001-ND - MODULE USB ADAPTR FOR FT2232D LP
813-1000-ND - MODULE USB ADAPTER FOR FT2232D
其它名稱： 768-1010-6
Copyright 2010 Future Technology Devices International Limited
11
Document No.: FT_000173
FT2232D DUAL USB TO SERIAL UART
/FIFO IC Datasheet
Version 2.05
Clearance No.: FTDI# 127
**Note 8: SI/WU is not available in these modes.
Channel B
Pin#
Generic
Pin
name
Pin Definitions by Chip Mode **Note 2
232
UART
Mode
245
FIFO
Enhanced
Asynchronous
and
Synchronous
Serial
MPSSE
**Note 4
MCU
Host Bus
Emulatio
n Mode
**Note 5
Fast
Opto-
Isolated
Serial
Mode
CPU
FIFO
Interface
Mode
40
BDBUS0
TXD
D0
A8
FSDI
D0
39
BDBUS1
RXD
D1
A9
FSCLK
D1
38
BDBUS2
RTS#
D2
A10
FSDO
D2
37
BDBUS3
CTS#
D3
A11
FSCTS
D3
36
BDBUS4
DTR#
D4
A12
**Note 3
D4
35
BDBUS5
DSR#
D5
A13
D5
33
BDBUS6
DCD#
D6
A14
D6
32
BDBUS7
RI#
D7
A15
D7
30
BCBUS0
TXDEN
RXF#
WR# **Note 9
CS#
29
BCBUS1
SLEEP#
TXE#
RD# **Note 9
ALE
A0
28
BCBUS2
RXLED#
RD#
WR# **Note 7
RD#
27
BCBUS3
TXLED#
WR
RD# **Note 7
WR#
26
SI/WUB
**Note 8
SI/WUB
**Note 8
40
BDBUS0
TXD
D0
A8
FSDI
D0
Table 3.6.6 Pin Definition by Chip Mode (Channel B)
**Note 2: 232 UART, 245 FIFO, CPU FIFO Interface, and Fast Opto-Isolated modes are
enabled in the external EEPROM. Enhanced Asynchronous and Synchronous Bit-Bang modes,
MPSSE, and MCU Host Bus Emulation modes are enabled using the driver command set bit
mode. See Section 3.3 for details.
**Note 3:
Channel A can be configured in another IO mode if channel B is in Fast Opto-
Isolated Serial Mode. If both Channel A and Channel B are in Fast Opto-Isolated Serial Mode all
of the IO will be on Channel B.
**Note 4: MPSSE is Channel A only.
**Note 5: MCU Host Bus Emulation requires both Channels.
**Note 6: The Bit-Bang Mode (synchronous and asynchronous) WR# and RD# strobes are on
these pins when the main Channel mode is 245 FIFO, CPU FIFO interface, or Fast Opto-Isolated
Serial Modes.
**Note 7: The Bit-Bang Mode (synchronous and asynchronous) WR# and RD# strobes are on
these pins when the main Channel mode is 232 UART Mode.
**Note 8: SI/WU is not available in these modes.
**Note 9: The Bit-Bang Mode (synchronous and asynchronous) WR# and RD# strobes are on these
pins when the main Channel mode is 245 FIFO, CPU FIFO interface. Bit-Bang mode is not available
on Channel B when Fast Opto-Isolated Serial Mode is enabled.
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