/FIFO IC <" />
參數(shù)資料
型號(hào)： FT2232D-REEL
廠商： FTDI, Future Technology Devices International Ltd
文件頁(yè)數(shù)： 2/61頁(yè)
文件大?。?/td> 0K
描述： IC USB FS DUAL UART/FIFO 48-LQFP
產(chǎn)品培訓(xùn)模塊： USB Introduction
標(biāo)準(zhǔn)包裝： 1
系列： USBmadeEZ-FIFO，F(xiàn)T-X，X-Chip
特點(diǎn)： USB 至 UART 和（或）FIFO、SPI、I2C、JTAG
通道數(shù)： 2，DUART
FIFO's： 384 字節(jié)
規(guī)程： RS232，RS422，RS485
電源電壓： 4.35 V ~ 5.25 V
帶并行端口： 是
帶自動(dòng)流量控制功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP
包裝： 標(biāo)準(zhǔn)包裝
產(chǎn)品目錄頁(yè)面： 634 (CN2011-ZH PDF)
配用： 768-1030-ND - MOD USB HS FT2232H EVAL
813-1009-ND - MODULE USB-TO-FPGA TOOL W/MANUAL
813-1001-ND - MODULE USB ADAPTR FOR FT2232D LP
813-1000-ND - MODULE USB ADAPTER FOR FT2232D
其它名稱： 768-1010-6
Copyright 2010 Future Technology Devices International Limited
10
Document No.: FT_000173
FT2232D DUAL USB TO SERIAL UART
/FIFO IC Datasheet
Version 2.05
Clearance No.: FTDI# 127
3.3 IO Pin Definitions by Chip Mode
The FT2232D will default to dual serial mode (232 UART mode on both channel A and B, if no external
EEPROM is used, or the external EEPROM is blank. The definition of the following pins varies according to
the chips mode:-
Channel A
Pin#
Generic
Pin
name
Pin Definitions by Chip Mode **Note 2
232
UART
Mode
245
FIFO
Enhanced
Asynchronous
and
Synchronous
Serial
MPSSE
**Note 4
MCU
Host Bus
Emulatio
n Mode
**Note 5
Fast
Opto-
Isolated
Serial
Mode
CPU
FIFO
Interfac
e Mode
24
ADBUS0
TXD
D0
TCK/SK
AD0
**Note 3
D0
23
ADBUS1
RXD
D1
TDI/D0
AD1
D1
22
ADBUS2
RTS#
D2
TDO/DI
AD2
D2
21
ADBUS3
CTS#
D3
TMS/CS
AD3
D3
20
ADBUS4
DTR#
D4
GPIOL0
AD4
D4
19
ADBUS5
DSR#
D5
GPIOL1
AD5
D5
17
ADBUS6
DCD#
D6
GPIOL2
AD6
D6
16
ADBUS7
RI#
D7
GPIOL3
AD7
D7
15
ACBUS0
TXDEN
RXF#
WR# **Note 6
GPIOH0
I/O0
CS#
13
ACBUS1
SLEEP#
TXE#
RD# **Note 6
GPIOH1
I/O1
A0
12
ACBUS2
RXLED#
RD#
WR# **Note 7
GPIOH2
IORDY
RD#
24
ADBUS0
TXD
D0
TCK/SK
AD0
**Note 3
D0
11
ACBUS3
TXLED#
WR
RD# **Note 7
GPIOH3
OSC
WR#
10
SI/WUA
**Note 8
Table 3.5.5 Pin Definition by Chip Mode (Channel A)
**Note 2: 232 UART, 245 FIFO, CPU FIFO Interface, and Fast Opto-Isolated modes are
enabled in the external EEPROM. Enhanced Asynchronous and Synchronous Bit-Bang modes,
MPSSE, and MCU Host Bus Emulation modes are enabled using the driver command set bit
mode. See Section 3.3 for details.
**Note 3:
Channel A can be configured in another IO mode if channel B is in Fast Opto-
Isolated Serial Mode. If both Channel A and Channel B are in Fast Opto-Isolated Serial Mode all
of the IO will be on Channel B.
**Note 4: MPSSE is Channel A only.
**Note 5: MCU Host Bus Emulation requires both Channels.
**Note 6: The Bit-Bang Mode (synchronous and asynchronous) WR# and RD# strobes are on
these pins when the main Channel mode is 245 FIFO, CPU FIFO interface, or Fast Opto-Isolated
Serial Modes.
**Note 7: The Bit-Bang Mode (synchronous and asynchronous) WR# and RD# strobes are on
these pins when the main Channel mode is 232 UART Mode.
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