參數(shù)資料
型號(hào)： FMS7401
廠商： Fairchild Semiconductor Corporation
元件分類： 基準(zhǔn)電壓源/電流源
英文描述： Digital Power Controller
中文描述： 數(shù)字電源控制器
文件頁(yè)數(shù)： 7/80頁(yè)
文件大?。?/td> 1535K
代理商： FMS7401
PRODUCT SPECIFICATION
FMS7401/7401L
REV. 1.0.2 6/23/04
7
List of Tables
Table 1.
Table 2.
Table 3.
Table 4.
Table 5.
Table 6.
Table 7.
Table 8.
Table 9.
Table 10.
Table 11.
Table 12.
Table 13.
Table 14.
Table 15.
Table 16.
Table 17.
Table 18.
Table 19.
Table 20.
Table 21.
Table 22.
Table 23.
Table 24.
Table 25.
Table 26.
Table 27.
Table 28.
Table 29.
Table 30.
Table 31.
Table 32.
Table 33.
Default Register States
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8
CMODE Bit Definition
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .10
PLL Frequency Selection (F
PLL
/F
OSC
= 2MHz)
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .10
HALT Register Definition
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .13
ADCNTRL1 Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .19
Analog Input Channel Selection (ACHSEL[3:0]) Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .19
ADCNTRL2 Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .21
Programmable Comparator (COMP) Control Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .25
Programmable Comparator Lower Voltage Reference V
THL
Programmable Comparator Upper Voltage Reference V
THU
Digital Delay (DDELAY) Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .31
Prescale (PSCALE) Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33
PLL Divide Factor Selection Bits and the F
T1CLK
Resolution (F
Timer 1 Prescale Selection (PS) Bits
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .34
Dead Time (DTIME) Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
Timer 1 Control (T1CNTRL) Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
Timer 1 Mode Configuration Bits
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
Timer 0 Control (T0CNTRL) Register Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41
Watchdog Service Register (WDSVR) Definition
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .42
I/O Register Bit Assignments
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .44
I/O Configuration Options
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .44
Multi-input Wakeup (MIW) Register Bit Assignments
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46
Interrupt Priority Sequence
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49
Instruction Addressing Modes
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .52
Instruction Cycles and Bytes
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53
Initialization Register 1 Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56
Initialization Register 3 Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56
Initialization Register 4 Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56
T1HS1 (G0) and T1HS2 (G5) Default Configuration
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .57
Memory Mapped Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .58
Memory Mapped Registers and their Register Bit Definitions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .59
Programming Interface Electrical Characteristics
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .60
32-Bit Command and Response Word
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .62
(Levels 1 – 31)
. . . . . . . . . . . . . . . . . . . . . . . . . . . .27
(Levels 32 – 63)
. . . . . . . . . . . . . . . . . . . . . . . . . . .28
OSC
=2 MHz)
. . . . . . . . . . . . . . . . . . . . . . . . . . . .33
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