RFB 3
參數(shù)資料
型號： EVAL-AD5543SDZ
廠商： Analog Devices Inc
文件頁數(shù)： 17/20頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD5543
標(biāo)準(zhǔn)包裝： 1
DAC 的數(shù)量： 1
位數(shù)： 16
數(shù)據(jù)接口： 串行
設(shè)置時間： 500ns
DAC 型： 電流
工作溫度： -40°C ~ 85°C
已供物品： 板
已用 IC / 零件： AD5543
AD5543/AD5553
Data Sheet
Rev. F | Page 6 of 20
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
CLK
1
SDI
2
RFB 3
VREF 4
CS
8
VDD
7
GND
6
IOUT
5
AD5543/
AD5553
TOP VIEW
(Not to Scale)
02917-
004
Figure 6. Pin Configuration
Table 3. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
CLK
Clock Input. Positive-edge triggered, clocks data into shift register.
2
SDI
Serial Register Input. Data loads directly into the shift register MSB first. Extra leading bits are ignored.
3
RFB
Internal Matching Feedback Resistor. This pin connects to an external op amp for voltage output.
4
VREF
DAC Reference Input Pin. Establishes DAC full-scale voltage. Constant input resistance vs. code.
5
IOUT
DAC Current Output. This pin connects to the inverting terminal of the external precision I-to-V op amp for
voltage output.
6
GND
Analog and Digital Ground.
7
VDD
Positive Power Supply Input. Specified range of operation at 5 V ± 10%.
8
CS
Chip Select. Active low digital input. Transfers shift-register data to DAC register on rising edge.
See Table 4 for operation.
Table 4. Control-Logic Truth Table
CLK
CS
Serial Shift Register Function
DAC Register
X
H
No effect
Latched
↑+1
L
Shift register data advanced one bit
Latched
H
No effect
Latched
↑+1
Shift register data transferred to DAC register
New data loaded from serial register
1
↑+ = positive logic transition; X = don't care.
相關(guān)PDF資料
PDF描述
V24C5E125BF CONVERTER MOD DC/DC 5V 125W
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EMC07DRTI CONN EDGECARD 14POS .100 EXTEND
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參數(shù)描述
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