參數(shù)資料
型號(hào)： EVAL-AD5061EBZ
廠商： Analog Devices Inc
文件頁數(shù)： 5/20頁
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描述： BOARD EVALUATION AD5061
產(chǎn)品培訓(xùn)模塊： DAC Architectures
標(biāo)準(zhǔn)包裝： 1
系列： nanoDAC™
DAC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 1.3M
數(shù)據(jù)接口： 串行
設(shè)置時(shí)間： 4µs
DAC 型： 電壓
工作溫度： -40°C ~ 85°C
已供物品： 板
已用 IC / 零件： AD5061
AD5061
Rev. B | Page 13 of 20
0.0010
0.0008
0.0006
0.0004
0.0002
0
–0.0002
–0.0004
–0.0006
–0.0008
–25 –20 –15 –10
–5
0
5
10
15
20
25
30
04
76
2-
05
1
VO
LT
A
G
E
(
V)
CURRENT (mA)
CODE = MIDSCALE
VDD = 5V, VREF = 4.096V
VDD = 3V, VREF = 2.5V
VDD = 5.5V
VDD = 3V
Figure 34. Typical Output Load Regulation
0.10
–0.10
–0.08
–0.06
–0.04
–0.02
0
0.02
0.04
0.06
0.08
–25 –20 –15 –10
–5
0
5
10
15
20
25
30
04
762
-06
3
V
OU
T
(V
)
IOUT (mA)
CODE = MIDSCALE
VDD = 5V, VREF = 4.096V
VDD = 3V, VREF = 2.5V
VDD = 5V, VREF = 4.096V
Figure 35. Typical Current Limiting Plot
2.1
1.0
1.1
1.2
1.3
1.4
1.5
1.6
1.7
1.8
1.9
2.0
–10s
9.96s
8s
6s
4s
2s
0
–2s
–4s
–6s
–8s
04
76
2-
05
2
VDD = 5.5V
VREF = 4.096V
10% TO 90% RISE TIME = 0.688s
SLEW RATE = 1.16V/s
DAC
OUTPUT
1.04V
2.04V
Figure 36. Typical Output Slew Rate
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PDF描述
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