參數(shù)資料
型號： EVAL-AD5061EBZ
廠商： Analog Devices Inc
文件頁數(shù)： 3/20頁
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描述： BOARD EVALUATION AD5061
產(chǎn)品培訓模塊： DAC Architectures
標準包裝： 1
系列： nanoDAC™
DAC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 1.3M
數(shù)據(jù)接口： 串行
設置時間： 4µs
DAC 型： 電壓
工作溫度： -40°C ~ 85°C
已供物品： 板
已用 IC / 零件： AD5061
AD5061
Rev. B | Page 11 of 20
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2
–40
–20
–0.10
0.10
0.08
0.06
0.04
0.02
0
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140
120
100
80
60
40
20
0
G
A
IN
E
R
RO
R
(
%
F
S
R
)
TEMPERATURE (°C)
VDD = 5.5V, VREF = 4.096V
VDD = 2.7V, VREF = 2.0V
GAIN ERROR @ VDD = 2.7V
GAIN ERROR @ VDD = 5.5V
Figure 22. Gain Error vs. Temperature
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0
2
3
0.83
0.84
0.85
0.86
0.87
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0.89
0.90
0.91
0
16
14
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10
8
6
4
2
MORE
FR
E
Q
U
E
N
C
Y
BIN
Figure 23. IDD Histogram @ VDD = 3 V
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2-
0
2
4
1.00 1.01 1.02 1.03 1.04 1.05 1.06 1.07 1.08 1.09 1.10 1.11
0
14
12
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8
6
4
2
MORE
FR
E
Q
U
E
N
C
Y
BIN
Figure 24. IDD Histogram @ VDD = 5 V
0
476
2-
0
25
CH1 2V/DIV CH2 1V/DIV TIME BASE = 100s
VDD = 5V VREF = 4.096VDD
RAMP RATE = 200s
TA = 25°C
CH1 = VDD
CH2 = VOUT
Figure 25. Hardware Power-Down Glitch
04
76
2-
0
26
CH1 2V/DIV CH2 2V/DIV CH3 20mV/DIV CH4 2V/DIV
TIME BASE 1s/DIV
CH3 = VOUT
CH4 = TRIGGER
CH2 = SYNC
CH1 = SCLK
VDD = 5V VREF = 4.096VDD
TA = 25°C
Figure 26. Exiting Software Power-Down Glitch
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76
2-
0
9
1
2.72.93.13.33.53.73.94.14.34.54.74.95.1
0
0.50
0.45
0.40
0.35
0.30
0.25
0.20
0.15
0.10
0.05
5.5
5.3
HE
AD
RO
O
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(
V
)
REFERENCE VOLTAGE (V)
Figure 27. VDD Headroom vs. Reference Voltage.
相關PDF資料
PDF描述
V375C2E50BG2 CONVERTER MOD DC/DC 2V 50W
DC1010A-B BOARD DELTA SIGMA ADC LTC2489
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