參數(shù)資料
型號： EVAL-AD5061EBZ
廠商： Analog Devices Inc
文件頁數(shù)： 4/20頁
文件大小： 0K
描述： BOARD EVALUATION AD5061
產(chǎn)品培訓(xùn)模塊： DAC Architectures
標(biāo)準(zhǔn)包裝： 1
系列： nanoDAC™
DAC 的數(shù)量： 1
位數(shù)： 16
采樣率（每秒）： 1.3M
數(shù)據(jù)接口： 串行
設(shè)置時間： 4µs
DAC 型： 電壓
工作溫度： -40°C ~ 85°C
已供物品： 板
已用 IC / 零件： AD5061
AD5061
Rev. B | Page 12 of 20
5.05
5.00
4.95
4.90
4.85
4.80
4.75
4.70
4.65
4.60
4.55
4.70 4.72 4.74 4.76 4.78 4.80 4.82 4.84 4.86 4.88 4.90 4.92 4.94 4.96 4.98 5.00
04
762
-04
2
DAC
O
U
T
P
U
T
(V
)
VREF (V)
VDD = 5.0V
TA = 25°C
DAC = FULL-SCALE
Figure 28. Typical Output Voltage vs. Reference Voltage
5.005
4.975
4.980
4.985
4.990
4.995
5.000
5.50
5.00
5.05
5.10
5.15
5.20
5.25
5.30
5.35
5.40
5.45
04
762
-06
5
DAC
O
U
T
P
U
T
(V
)
VDD (V)
VREF = 5V
TA = 25°C
Figure 29. Typical Output Voltage vs. Supply Voltage
04
76
2-
04
7
CH4 50.0mV
M4.00s
CH1
1.64V
C4 = 143mV p-p
1k TO GND
ZERO-SCALE
Figure 30. Typical Glitch upon Entering Software Power-Down to Zero-Scale
04
76
2-
04
8
CH4 20.0mV
M1.00s
CH1
1.64V
C4 = 50mV p-p
1k TO GND
ZERO-SCALE
Figure 31. Typical Glitch upon Exiting Software Power-Down to Zero-Scale
04
76
2-
04
9
CH3 2.00V
CH2 50mV
M1.00ms
CH3
1.36V
2
C2
25mV p-p
C3
4.96V p-p
C3 FALL
935.0s
C3 RISE
∞s
NO VALID
EDGE
3
T
Figure 32. Typical Glitch upon Exiting Hardware Power-Down to Three State
04
76
2-
05
0
CH3 2.00V
CH2 50mV
M1.00ms
CH3
1.36V
2
C2
30mV p-p
C3
4.96V p-p
C3 FALL
∞s
NO VALID
EDGE
C3 RISE
946.2s
3
T
Figure 33. Typical Glitch upon Entering Hardware Power-Down to Zero-Scale
相關(guān)PDF資料
PDF描述
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