參數(shù)資料
型號: EP20K60ETI144-2ES
英文描述: FPGA
中文描述: FPGA的
文件頁數(shù): 99/114頁
文件大?。?/td> 1623K
代理商: EP20K60ETI144-2ES
Altera Corporation
85
APEX 20K Programmable Logic Device Family Data Sheet
Notes to tables:
(1)
This parameter is measured without using ClockLock or ClockBoost circuits.
(2)
This parameter is measured using ClockLock or ClockBoost circuits.
Tables 53 through 58 describe fMAX LE Timing Microparameters, fMAX
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K30E APEX 20KE devices.
Table 52. EP20K400 External Bidirectional Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR (1)
1.4
1.8
2.0
ns
tINHBIDIR (1)
0.0
ns
tOUTCOBIDIR (1)
2.0
4.9
2.0
6.1
2.0
7.0
ns
tXZBIDIR (1)
7.3
8.9
10.3
ns
tZXBIDIR (1)
7.3
8.9
10.3
ns
tINSUBIDIR (2)
0.5
1.0
ns
tINHBIDIR (2)
0.0
ns
tOUTCOBIDIR (2)
0.5
3.1
0.5
4.1
––
ns
tXZBIDIR (2)
6.2
7.6
ns
tZXBIDIR (2)
6.2
7.6
ns
Table 53. EP20K30E Fmax LE Timing Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tSU
0.01
0.02
ns
tH
0.11
0.16
0.23
ns
tCO
0.32
0.45
0.67
ns
tLUT
0.85
1.20
1.77
ns
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