參數資料
型號： EP1K50FI484-2DX
英文描述： Field Programmable Gate Array (FPGA)
中文描述： 現場可編程門陣列（FPGA）
文件頁數： 74/86頁
文件大?。?/td> 1263K
代理商： EP1K50FI484-2DX
76
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Tables 51 through 57 show EP1K100 device internal and external timing
parameters.
Table 51. EP1K100 Device LE Timing Microparameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tLUT
0.7
1.0
1.5
ns
tCLUT
0.5
0.7
0.9
ns
tRLUT
0.6
0.8
1.1
ns
tPACKED
0.3
0.4
0.5
ns
tEN
0.2
0.3
ns
tCICO
0.1
0.2
ns
tCGEN
0.4
0.5
0.7
ns
tCGENR
0.1
0.2
ns
tCASC
0.6
0.9
1.2
ns
tC
0.8
1.0
1.4
ns
tCO
0.6
0.8
1.1
ns
tCOMB
0.4
0.5
0.7
ns
tSU
0.4
0.6
0.7
ns
tH
0.5
0.7
0.9
ns
tPRE
0.8
1.0
1.4
ns
tCLR
0.8
1.0
1.4
ns
tCH
1.5
2.0
2.5
ns
tCL
1.5
2.0
2.5
ns
相關PDF資料
PDF描述
EP1K50FI484-2F Field Programmable Gate Array (FPGA)
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EP1K50FI484-3F Field Programmable Gate Array (FPGA)
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