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參數(shù)資料
| 型號： | DSP56857BUE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 46/53頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 16BIT 120MHZ 100-LQFP |
| 標準包裝： | 90 |
| 系列： | 568xx |
| 核心處理器： | 56800E |
| 芯體尺寸： | 16-位 |
| 速度： | 120MHz |
| 連通性： | SCI，SPI，SSI |
| 外圍設備： | DMA，POR，WDT |
| 輸入/輸出數(shù)： | 47 |
| 程序存儲器容量： | 80KB（40K x 16） |
| 程序存儲器類型： | SRAM |
| RAM 容量： | 24K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.62 V ~ 1.98 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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56857 Technical Data, Rev. 6
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Freescale Semiconductor
Take special care to minimize noise levels on the VDDA and VSSA pins.
When using Wired-OR mode on the SPI or the IRQx pins, the user must provide an external pull-up device.
Designs that utilize the TRST pin for JTAG port or Enhance OnCE module functionality (such as
development or debugging systems) should allow a means to assert TRST whenever RESET is asserted, as
well as a means to assert TRST independently of RESET. Designs that do not require debugging
functionality, such as consumer products, should tie these pins together.
The internal POR (Power on Reset) will reset the part at power on with reset asserted or pulled high but
requires that TRST be asserted at power on.
相關PDF資料 |
PDF描述 |
|---|---|
| DSP56858FVE | IC DSP 16BIT 120MHZ 144-LQFP |
| DSP56F801FA80E | IC DSP 60MHZ 16KB FLASH 48-LQFP |
| DSP56F802TA80E | IC DSP 60MHZ 16KB FLASH 32-LQFP |
| DSP56F803BU80E | IC DSP 80MHZ 64KB FLASH 100LQFP |
| DSP56F805FV80E | IC DSP 80MHZ 64KB FLASH 144LQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DSP56857E | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| DSP56857PB | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| DSP56858 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| DSP56858E | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
| DSP56858EVM | 制造商:Freescale Semiconductor 功能描述:Microprocessor Support IC For Use With:D |
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