參數(shù)資料
型號： DS34T102GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 102/366頁
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 484TEBGA
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： TDM（分時復用）
應用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA 裸露焊盤
供應商設備封裝： 484-HSBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
190 of 366
Bank1 Timeslot Assignment Registers
Ports 1 to 4: 0x000+(port-1)*0x80+ts*4
Ports 5 to 8: 0x400+(port-5)*0x80+ts*4
Bank2 Timeslot Assignment Registers
Ports 1 to 4: 0x200+(port-1)*0x80+ts*4
Ports 5 to 8: 0x600+(port-5)*0x80+ts*4
Bits
Data Element Name
R/W
Reset
Value
Description
[31:21]
Reserved
-
None
Must be set to zero
[20]
Remote_loop
R/W
None
When set, establishes a loop (per timeslot) between the
data received from the Ethernet port and the data
transmitted towards the Ethernet port.
Notes:
Usually the remote loop is activated on all timeslots
assigned to a bundle.
Only the TDM data is looped back. CAS information is not
looped back.
Available only when interface is configured to single clock
[19]
Local_loop
R/W
None
When set, establishes a loop (per timeslot) between the
data received from the TDM port and the data transmitted
towards the TDM port. The data transmitted towards the
TDM port is delayed by one TDM frame vs. the received
data.
Notes:
Usually the local loop is activated on all timeslots
assigned to a bundle.
Only the TDM data is looped back. CAS information is not
looped back.
Available only when interface is configured to single clock
[18]
Structured_type
R/W
Must be set for timeslots that are part of AAL1/CESoPSN
bundles whose type is structured or structured-with-CAS.
[17:16]
Timeslot_width
R/W
None
00 = Reserved
01 =2 bits (only for HDLC bundles)
10 = 7 bits (only for HDLC bundles)
11 = 8 bits
See section 10.6.4 for additional details.
[15]
First_in_bundle
R/W
None
Must be set for the first timeslot of an AAL1 or CESoPSN
bundle. Must be cleared for HDLC bundles.
[14]
Rx_assigned
R/W
None
0 = timeslot is not assigned for the Rx path
1 = timeslot is assigned for the Rx path
[13]
Transmit_assigned
R/W
None
0 = timeslot is not assigned for the transmit path
1 = timeslot is assigned for the transmit path
[12:7]
Bundle_number
R/W
None
Number of the bundle that the timeslot is assigned to.
[6:5]
Reserved
R/W
None
Must be set to zero
[4:0]
Jitter_buffer_index
R/W
None
Jitter buffer index. This field indicates which jitter buffer is
being used for the timeslot or bundle. It is also the index
If a timeslot is assigned to a bundle, the jitter buffer index
must be configured to the number of the first timeslot
assigned to the bundle. Otherwise, it must be configured
to the timeslot number. See section 10.6.10.
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PDF描述
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參數(shù)描述
DS34T102GN+ 功能描述:網(wǎng)絡控制器與處理器 IC Dual TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS34T104 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T104GN 功能描述:網(wǎng)絡控制器與處理器 IC Quad TDM Over Packet Chip RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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