參數(shù)資料
型號(hào)： DS33Z11
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 網(wǎng)絡(luò)接口
英文描述： Ethernet Mapper
中文描述： DATACOM, NETWORK INTERFACE SUPPORT CIRCUIT, PBGA169
封裝： 14 X 14 MM, 1 MM PITCH, CSBGA-169
文件頁數(shù)： 82/169頁
文件大?。?/td> 1049K
代理商： DS33Z11
DS33Z11 Ethernet Mapper
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
82 of 169
BPCLR
BERT Pattern Configuration Low Register
82h
7
-
0
6
5
4
3
2
1
0
QRSS
0
PTS
0
PLF4
0
PLF3
0
PLF2
0
PLF1
0
PLF0
0
Bit 6: QRSS Enable (QRSS)
When 0, the pattern generator configuration is controlled by PTS, PLF[0:4], and
PTF[0:4], and BSP[0:31]. When 1, the pattern generator configuration is forced to a QRSS pattern with a
generating polynomial of x
+ x
+ 1. The output of the pattern generator is forced to one if the next fourteen
output bits are all zero.
Bit 5: Pattern Type Select (PTS)
When 0, the pattern is a PRBS pattern. When 1, the pattern is a repetitive
pattern.
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bits 4 to 0:
Pattern Tap Feedback (PTF[4:0])
These five bits control the PRBS “tap” feedback of the pattern
generator. The “tap” feedback is from bit y of the pattern generator (y = PTF[4:0] +1). These bits are ignored when
programmed for a repetitive pattern. For a PRBS signal, the feedback is an XOR of bit n and bit y. The values
possible are outlined in Section
8.15
.
BPCHR
BERT Pattern Configuration High Register
83h
7
-
0
6
-
0
5
-
0
4
3
2
1
0
PTF4
0
PTF3
0
PTF2
0
PTF1
0
PTF0
0
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PDF描述
DS33ZH11 Ethernet Mapper
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