參數(shù)資料
型號： DS3134
英文描述： Chateau Channelized T1 And E1 And HDLC Controller
中文描述： 不推薦用于新設計
文件頁數(shù)： 36/203頁
文件大?。?/td> 777K
代理商： DS3134
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DS3134
36 of 203
3.6 BERT REGISTERS (5XX)
Offset/
Address
0500
BERTC0
0504
BERTC1
0508
BERTRP0
050C
BERTRP1
0510
BERTBC0
0514
BERTBC1
0518
BERTEC0
051C
BERTEC1
Acronym
Register Name
Section
BERT Control 0.
BERT Control 1.
BERT Repetitive Pattern Set 0 (lower word).
BERT Repetitive Pattern Set 1 (upper word).
BERT Bit Counter 0 (lower word).
BERT Bit Counter 1 (upper word).
BERT Error Counter 0 (lower word).
BERT Error Counter 1 (upper word).
5.6
5.6
5.6
5.6
5.6
5.6
5.6
5.6
3.7 RECEIVE DMA REGISTERS (7XX)
Offset/
Address
0700
RFQBA0
0704
RFQBA1
0708
RFQEA
070C
RFQSBSA
0710
RFQLBWP
0714
RFQSBWP
0718
RFQLBRP
071C
RFQSBRP
0730
RDQBA0
0734
RDQBA1
0738
RDQEA
073C
RDQRP
0740
RDQWP
0744
RDQFFT
0750
RDBA0
0754
RDBA1
0770
RDMACIS
0774
RDMAC
0780
RDMAQ
0790
RLBS
0794
RSBS
Acronym
Register Name
Section
Receive Free Queue Base Address 0 (lower word).
Receive Free Queue Base Address 1 (upper word).
Receive Free Queue End Address.
Receive Free Queue Small Buffer Start Address.
Receive Free Queue Large Buffer Host Write Pointer.
Receive Free Queue Small Buffer Host Write Pointer.
Receive Free Queue Large Buffer DMA Read Pointer.
Receive Free Queue Small Buffer DMA Read Pointer.
Receive Done Queue Base Address 0 (lower word).
Receive Done Queue Base Address 1 (upper word).
Receive Done Queue End Address.
Receive Done Queue Host Read Pointer.
Receive Done Queue DMA Write Pointer.
Receive Done Queue FIFO Flush Timer.
Receive Descriptor Base Address 0 (lower word).
Receive Descriptor Base Address 1 (upper word).
Receive DMA Configuration Indirect Select.
Receive DMA Configuration.
Receive DMA Queues Control.
Receive Large Buffer Size.
Receive Small Buffer Size.
8.1.3
8.1.3
8.1.3
8.1.3
8.1.3
8.1.3
8.1.3
8.1.3
8.1.4
8.1.4
8.1.4
8.1.4
8.1.4
8.1.4
8.1.2
8.1.2
8.1.5
8.1.5
8.1.3/.4
8.1.1
8.1.1
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PDF描述
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