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參數(shù)資料
| 型號： | DS3134 |
| 英文描述： | Chateau Channelized T1 And E1 And HDLC Controller |
| 中文描述： | 不推薦用于新設(shè)計 |
| 文件頁數(shù)： | 163/203頁 |
| 文件大?。?/td> | 777K |
| 代理商： | DS3134 |
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DS3134
163 of 203
SECTION 10: LOCAL BUS
10.1 LOCAL BUS GENERAL DESCRIPTION
The Local Bus can operate in two modes, as a PCI Bridge (master mode) and as a Configuration Bus
(slave mode). This selection is made in hardware by tying the LMS pin high or low. Figures 10.1A
through 10.1C describe the two modes. Figure 10.1A shows an example of the Local Bus being operated
in the PCI Bridge Mode. In this example, the Host can access the control ports on the T1/E1 devices via
the Local Bus.
Figure 10.1B also shows an example of the PCI Bridge Mode but in this example, the Local Bus
Arbitration is enabled which allows a Local CPU to control when the Host can have access to the Local
Bus. To access the Local Bus, the Host must first request the bus and then wait until it is granted.
Figure 10.1C displays an example of the Configuration Mode. In this mode, the CPU on the Local Bus
will configure and monitor the DS3134. In this mode, the Host on the PCI/Custom Bus cannot access the
DS3134 and the PCI/Custom Bus is only used to transfer HDLC packet data to and from the Host.
Table 10.1A lists all of the Local Bus pins and their application in both operating modes. The Local Bus
operates only in a non-multiplexed fashion; it is not capable of operating as a multiplexed bus. For both
operating modes, the Local Bus can be set up for either Intel or Motorola type busses. This selection is
made in hardware by tying the LIM pin high or low.
Local Bus Signals
Table 10.1A
Signal Name
Signal Description
PCI Bridge Mode
(LMS = 0)
Input on Read /
Output on Write
Output
Output
Output
Output
Input
Input
Input
Output
Input
Ignored
Output
Input
Output
Configuration Mode
(LMS = 1)
Input on Write /
Output on Read
Input
Input
Input
Tri-Stated
Input
Output
Input
Tri-Stated
Ignored
Input
Tri-Stated
Ignored
Tri-Stated
LD[0:15]
Data Bus
LA[0:19]
LWR*(LR/W*)
LRD*(LDS*)
LBHE*
LIM
LINT*
LMS
LCLK
LRDY*
LCS*
LHOLD(LBR*)
LHLDA(LBG*)
LBGACK*
Address Bus
Bus Write (Read/Write Select)
Bus Read (Data Strobe)
Byte High Enable
Intel/Motorola Select
Interrupt
Mode Select
Bus Clock
Bus Ready
Chip Select
Hold Request (Bus Request)
Hold Acknowledge (Bus Grant)
Bus Acknowledge
Notes:
1. Signals shown in parenthesis () are active when Motorola Mode (LIM = 1) is selected.
2. Signals suffixed with an asterisk (*) are active low signals.
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