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參數(shù)資料
| 型號： | CY39030V |
| 英文描述： | Programmable Logic |
| 中文描述： | 可編程邏輯 |
| 文件頁數(shù)： | 62/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39030V |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 62 of 86
E4
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IO0
IO7
IO7
IO7
IO7
IO6
IO6
IO6
TMS
IO5
IO5
IO5
IO5
IO0
V
CC
V
CCIO0
IO/V
REF0
IO0
IO7
GCTL3
GCLK3
GCTL2
GCLK2
IO5
IO5
IO/V
REF5
V
CCIO5
V
CCJTAG
IO5
IO0
NC
V
CCIO0
IO/V
REF0
IO0
GCTL0
GND
GND
GND
GND
GCTL1
IO5
IO/V
REF5
V
CCIO5
NC
IO0
IO7
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IO6
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TMS
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CC
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REF0
IO0
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GCTL2
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IO5
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IO/V
REF5
V
CCIO5
V
CCJTAG
IO5
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NC
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CCIO0
IO/V
REF0
IO0
GCTL0
GND
GND
GND
GND
GCTL1
IO5
IO/V
REF5
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CCIO5
NC
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TMS
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V
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GCTL2
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CCJTAG
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CC
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Table 13. 256 FBGA Pin Table
(continued)
Pin
CY39030
CY39050
CY39100
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39165V | Programmable Logic |
| CY39200V | Programmable Logic |
| CY3930V208-200MGC | CAP CER 1000PF 50V X7R 0805 FLEX |
| CY3950V208-200MGC | CAP CER 10000PF 50V X7R 0805 FLX |
| CY39100V208-200MGC | CAP CER .10UF 50V X7R 0805 FLEX |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39030V208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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