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參數(shù)資料
| 型號： | CY39030V |
| 英文描述： | Programmable Logic |
| 中文描述： | 可編程邏輯 |
| 文件頁數(shù)： | 26/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39030V |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 26 of 86
Switching Waveforms
(continued)
Asynchronous Reset/Preset
INPUT
t
PRO
REGISTERED
OUTPUT
CLOCK
t
PRR
t
PRW
RESET/PRESET
Output Enable/Disable
GLOBAL CONTROL
t
ER
OUTPUTS
t
EA
INPUT
相關PDF資料 |
PDF描述 |
|---|---|
| CY39165V | Programmable Logic |
| CY39200V | Programmable Logic |
| CY3930V208-200MGC | CAP CER 1000PF 50V X7R 0805 FLEX |
| CY3950V208-200MGC | CAP CER 10000PF 50V X7R 0805 FLX |
| CY39100V208-200MGC | CAP CER .10UF 50V X7R 0805 FLEX |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CY39030V208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BGC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125BGI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39030V208-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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