參數(shù)資料
型號： CY28412
英文描述： Clocks and Buffers
中文描述： 時鐘和緩沖器
文件頁數(shù)： 10/48頁
文件大?。?/td> 538K
代理商： CY28412
CY28405-2
Document #: 38-07511 Rev. *C
Page 10 of 16
FS_A, FS_B
VTT_PWRGD#
PWRGD_VRM
VDD Clock Gen
Clock State
Clock Outputs
Clock VCO
0.2-0.3mS
Delay
State 0
State 2
State 3
Wait for
VTT_PWRGD#
Sample Sels
Off
Off
On
On
State 1
Device is not affected,
VTT_PWRGD# is ignored
Figure 5. VTT_PWRGD
#
Timing Diagram
VTT_PWRGD# = Low
Delay
>0.25mS
S1
Power Off
S0
VDD_A = 2.0V
Sample
Inputs straps
S2
Normal
Operation
Wait for <1.8ms
Enable Outputs
S3
VTT_PWRGD# = toggle
VDD_A = off
Figure 6. Clock Generator Power-up/Run State Diagram
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PDF描述
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CY28412OXCT 制造商:SPECTRALINEAR 制造商全稱:SPECTRALINEAR 功能描述:Clock Generator for Intel㈢ Grantsdale Chipset
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